参数资料
| 型号： | A1425A-VQG100I |
| 厂商： | Microsemi SoC |
| 文件页数： | 3/90页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 2500 GATES 100-VQFP |
| 产品变化通告： | A1425A Family Discontinuation 23/Jan/2012 |
| 标准包装： | 90 |
| 系列： | ACT™ 3 |
| LAB/CLB数： | 310 |
| 输入/输出数： | 83 |
| 门数： | 2500 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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Accelerator Series FPGAs – ACT 3 Family
R e visio n 3
2 -3
The S-module contains a full implementation of the C-module plus a clearable sequential element that
can either implement a latch or flip-flop function. The S-module can therefore implement any function
implemented by the C-module. This allows complex combinatorial-sequential functions to be
implemented with no delay penalty. The Designer Series Development System will automatically
combine any C-module macro driving an S-module macro into the S-module, thereby freeing up a logic
module and eliminating a module delay.
The clear input CLR is accessible from the routing channel. In addition, the clock input may be connected
to one of three clock networks: CLKA, CLKB, or HCLK. The C-module and S-module functional
descriptions are shown in Figure 2-2 and Figure 2-3 on page 2-2. The clock selection is determined by a
multiplexer select at the clock input to the S-module.
I/Os
I/O Modules
I/O modules provide an interface between the array and the I/O Pad Drivers. I/O modules are located in
the array and access the routing channels in a similar fashion to logic modules. The I/O module
schematic is shown in Figure 4. The signals DataIn and DataOut connect to the I/O pad driver.
Each I/O module contains two D-type flip-flops. Each flip-flop is connected to the dedicated I/O clock
(IOCLK). Each flip-flop can be bypassed by nonsequential I/Os. In addition, each flip-flop contains a data
enable input that can be accessed from the routing channels (ODE and IDE). The asynchronous
preset/clear input is driven by the dedicated preset/clear network (IOPCL). Either preset or clear can be
selected individually on an I/O module by I/O module basis.
Figure 2-4
Functional Diagram for I/O Module
D
DATAOUT
D
Q
CLR/PRE
DATAIN
IOCLK
IOPCL
Y
D
Q
CLR/PRE
ODE
MUX
1
0
MUX
1
0
MUX
0
1
MUX
3
0
1
2
S1
S0
相关PDF资料 |
PDF描述 |
|---|---|
| A1425A-VQ100C | IC FPGA 2500 GATES 100-VQFP |
| IDT71V416S12BEG8 | IC SRAM 4MBIT 12NS 48FBGA |
| HMC65DRTS-S734 | CONN EDGECARD 130PS DIP .100 SLD |
| HMC65DRES-S734 | CONN EDGECARD 130PS .100 EYELET |
| AMC36DRXI-S734 | CONN EDGECARD 72POS DIP .100 SLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| A1425LK | 功能描述:IC SENSOR HALL EFFECT AC 4-SIP RoHS:否 类别:传感器，转换器 >> 磁性 - 霍尔效应，数字式开关，线性，罗盘 (IC) 系列:- 标准包装:1 系列:- 传感范围:20mT ~ 80mT 类型:旋转 电源电压:4.5 V ~ 5.5 V 电流 - 电源:15mA 电流 - 输出（最大）:- 输出类型:数字式，PWM，8.5 位串行 特点:可编程 工作温度:-40°C ~ 150°C 封装/外壳:20-SSOP（0.209"，5.30mm 宽） 供应商设备封装:20-SSOP 包装:Digi-Reel® 其它名称:AS5132-HSST-500DKR |
| A1425LK-T | 功能描述:IC SENSOR HALL EFFECT AC 4-SIP RoHS:是 类别:传感器，转换器 >> 磁性 - 霍尔效应，数字式开关，线性，罗盘 (IC) 系列:- 标准包装:1 系列:- 传感范围:20mT ~ 80mT 类型:旋转 电源电压:4.5 V ~ 5.5 V 电流 - 电源:15mA 电流 - 输出（最大）:- 输出类型:数字式，PWM，8.5 位串行 特点:可编程 工作温度:-40°C ~ 150°C 封装/外壳:20-SSOP（0.209"，5.30mm 宽） 供应商设备封装:20-SSOP 包装:Digi-Reel® 其它名称:AS5132-HSST-500DKR |
| A1425-PQ160C | 制造商:Microsemi SOC Products Group 功能描述: |
| A1428AG1 | 制造商:DBLECTRO 制造商全称:DB Lectro Inc 功能描述:DIP PLUG PITCH:2.54mm |
| A1428AG2 | 制造商:DBLECTRO 制造商全称:DB Lectro Inc 功能描述:DIP PLUG PITCH:2.54mm |
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