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参数资料
| 型号： | B32523Q6224J |
| 厂商： | EPCOS Inc |
| 文件页数： | 23/45页 |
| 文件大小： | 0K |
| 描述： | FILM CAP 0.22UF 5% 400V |
| 标准包装： | 720 |
| 系列： | B32523 |
| 电容： | 0.22µF |
| 额定电压 - AC： | 200V |
| 额定电压 - DC： | 400V |
| 电介质材料： | 聚酯，金属化 |
| 容差： | ±5% |
| ESR（等效串联电阻）： | * |
| 工作温度： | -55°C ~ 125°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 径向 |
| 尺寸/尺寸： | 1.043" L x 0.236" W（26.50mm x 6.00mm） |
| 高度 - 座高（最大）： | 0.591"（15.00mm） |
| 端子： | PC 引脚 |
| 引线间隔： | 0.886"（22.50mm） |
| 特点： | 通用 |
| 应用： | * |
| 包装： | 散装 |
| 其它名称： | B32523Q6224J000 |
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B32520 ... B32529
General purpose (stacked/wound)
Pulse handling capability
"dV/dt" represents the maximum permissible voltage change per unit of time for non-sinusoidal
voltages, expressed in V/ μ s.
"k 0 " represents the maximum permissible pulse characteristic of the waveform applied to the
capacitor, expressed in V 2 / μ s.
Note:
The values of dV/dt and k 0 provided below must not be exceeded in order to avoid damaging the
capacitor.
dV/dt values
Lead spacing 5 mm
7.5 mm
10 mm
15 mm
22.5 mm 27.5 mm 37.5 mm
Technology
S
S
S
W
S
W
W
W
W
V R
V DC
V RMS
V AC dV/dt in V/ μ s
50
32
200
63
40
250
120
50
30
3
1
0.8
100
250
400
63
160
200
300
400
600
150
200
275
75
150
175
50
100
125
5
10
4
8
10
3
5
8.5
1
4
6
450
200
20
630
400
800
320
150
15
12
S = Stacked, W = Wound
k 0 values
Lead spacing 5 mm
7.5 mm
10 mm
15 mm
22.5 mm 27.5 mm 37.5 mm
Technology
S
S
S
W
S
W
W
W
W
V R
V DC
V RMS
V AC k 0 in V 2 / μ s
50
32
20000
63
40
30000
15000
6300
3800
375
130
100
100
250
400
63
160
200
60000
200000
500000
30000
100000
220000
15000
75000
140000
10000
50000
100000
850
5000
800
4000
10000
600
2500
8500
200
2000
6000
450
200
15000
630
400
1000000
400000
190000
18000
15000
S = Stacked, W = Wound
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