参数资料
| 型号： | EP4CGX75CF23I7 |
| 厂商： | Altera |
| 文件页数： | 24/42页 |
| 文件大小： | 0K |
| 描述： | IC CYCLONE IV GX FPGA 75K 484FBG |
| 产品培训模块： | Cyclone IV FPGA Family Overview |
| 特色产品： | Cyclone? IV FPGAs |
| 标准包装： | 60 |
| 系列： | CYCLONE® IV GX |
| LAB/CLB数： | 4620 |
| 逻辑元件/单元数： | 73920 |
| RAM 位总计： | 4257792 |
| 输入/输出数： | 290 |
| 电源电压： | 1.16 V ~ 1.24 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 484-BGA |
| 供应商设备封装： | 484-FBGA（23x23） |
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1–30
Chapter 1: Cyclone IV Device Datasheet
Switching Characteristics
December 2013
Altera Corporation
tLOCK (2)
—
1
—
1
—
—1
—
1—
—
1
ms
Notes to Table 1–32:
(1) Emulated RSDS_E_1R transmitter is supported at the output pin of all I/O Banks of Cyclone IV E devices and I/O Banks 3, 4, 5, 6, 7, 8, and 9 of Cyclone IV GX
devices.
(2) tLOCK is the time required for the PLL to lock from the end-of-device configuration.
(3) Cyclone IV E 1.0 V core voltage devices only support C8L, C9L, and I8L speed grades. Cyclone IV E 1.2 V core voltage devices only support C6, C7, C8, I7, and
A7 speed grades. Cyclone IV GX devices only support C6, C7, C8, and I7 speed grades.
Table 1–32. Emulated RSDS_E_1R Transmitter Timing Specifications for Cyclone IV Devices (1), (3) (Part 2 of 2)
Symbol
Modes
C6
C7, I7
C8, A7
C8L, I8L
C9L
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Table 1–33. Mini-LVDS Transmitter Timing Specifications for Cyclone IV Devices (1), (2), (4)
Symbol
Modes
C6
C7, I7
C8, A7
C8L, I8L
C9L
Unit
Min
Typ
Max Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
fHSCLK (input
clock
frequency)
×10
5
—
200
5
—
155.5
5
—
155.5
5
—
155.5
5
—
132.5
MHz
×8
5
—
200
5
—
155.5
5
—
155.5
5
—
155.5
5
—
132.5
MHz
×7
5
—
200
5
—
155.5
5
—
155.5
5
—
155.5
5
—
132.5
MHz
×4
5
—
200
5
—
155.5
5
—
155.5
5
—
155.5
5
—
132.5
MHz
×2
5
—
200
5
—
155.5
5
—
155.5
5
—
155.5
5
—
132.5
MHz
×1
5
—
400
5
—
311
5
—
311
5
—
311
5
—
265
MHz
Device
operation in
Mbps
×10
100
—
400
100
—
311
100
—
311
100
—
311
100
—
265
Mbps
×8
80
—
400
80
—
311
80
—
311
80
—
311
80
—
265
Mbps
×7
70
—
400
70
—
311
70
—
311
70
—
311
70
—
265
Mbps
×4
40
—
400
40
—
311
40
—
311
40
—
311
40
—
265
Mbps
×2
20
—
400
20
—
311
20
—
311
20
—
311
20
—
265
Mbps
×1
10
—
400
10
—
311
10
—
311
10
—
311
10
—
265
Mbps
tDUTY
—
45
—
55
45
—
55
45
—
55
45
—
55
45
—
55
%
TCCS
—
200
—
200
—
200
—
200
—
200
ps
Output jitter
(peak to peak)
—
500
—
500
—
550
—
600
—
700
ps
tRISE
20 – 80%,
CLOAD =
5pF
—
500
—
500
—
500
—
500
—
500
—
ps
tFALL
20 – 80%,
CLOAD =
5pF
—
500
—
500
—
500
—
500
—
500
—
ps
tLOCK (3)
—
—1—
—
1
—
1
—
1
—
1
ms
Notes to Table 1–33:
(1) Applicable for true and emulated mini-LVDS transmitter.
(2) Cyclone IV E—true mini-LVDS transmitter is only supported at the output pin of Row I/O Banks 1, 2, 5, and 6. Emulated mini-LVDS transmitter is supported at
the output pin of all I/O banks.
Cyclone IV GX—true mini-LVDS transmitter is only supported at the output pin of Row I/O Banks 5 and 6. Emulated mini-LVDS transmitter is supported at the
output pin of I/O Banks 3, 4, 5, 6, 7, 8, and 9.
(3) tLOCK is the time required for the PLL to lock from the end-of-device configuration.
(4) Cyclone IV E 1.0 V core voltage devices only support C8L, C9L, and I8L speed grades. Cyclone IV E 1.2 V core voltage devices only support C6, C7, C8, I7, and
A7 speed grades. Cyclone IV GX devices only support C6, C7, C8, and I7 speed grades.
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PDF描述 |
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参数描述 |
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| EP4CGX75DF27C6 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Cyclone IV GX 4620 LABs 310 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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