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参数资料
| 型号： | MB9BF305NABGL |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PBGA112 |
| 封装： | 10 X 10 MM, 1.45 MM HEIGHT, 0.80 MM PITCH, PLASTIC, FBGA-112 |
| 文件页数： | 90/104页 |
| 文件大小： | 1005K |
| 代理商： | MB9BF305NABGL |
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86
FUJITSU SEMICONDUCTOR CONFIDENTIAL
r3.0
MB9B300A Series
12bit A/D Converter
This chapter shows the electrical characteristics for the A/D converter.
1. Electrical characteristics for the A/D converter.
(Vcc = AVcc = 2.7V to 5.5V, Vss = AVss = 0V Ta = - 40
°C to + 85°C)
Value
Parameter
Pin
name
Min
Typ
Max
Unit
Remarks
Resolution
-
12
bit
Linearity error
-
- 4.5
-
+ 4.5
LSB
Differential linearity
error
-
-2.5
-
+ 2.5
LSB
Zero transition voltage
AN0
to AN15
- 20
-
+ 20
mV
Full transition voltage
AN0
to AN15
- 20
-
+ 20
mV
AVRH = 2.7V to 5.5V
Conversion time
-
1.0 (*1)
-
μsAVcc ≥ 4.5V
*2
-
AVcc ≥ 4.5V
Sampling time
Ts
*2
-
ns
AVcc < 4.5V
55.5
AVcc ≥ 4.5V
Compare clock cycle *3
Tcck
166.6(*4)
-
10000
ns
AVcc < 4.5V
State transition time to
operation permission
Tstt
2.5
-
μs
-
2.3
3.6
mA A/D 1unit operation
Power supply current
(analog + digital)
AVCC
-
0.1
2
μA When ADC stop
-
2.2
3.0
mA
A/D 1unit operation
AVRH=5.5V
Reference power supply
current
(between AVRH to
AVSS)
AVRH
-
0.03
0.6
μA When ADC stop
Analog input capacity
Cin
-
14.5
pF
0.93
AVcc ≥ 4.5V
Analog input resistance
Rin
-
2.04
k
AVcc < 4.5V
Interchannel disparity
-
4
LSB
Analog port input
current
AN0
to AN15
-
5
μA
Analog input voltage
AN0
to AN15
AVSS
-
AVRH
V
Reference voltage
AVRH
AVSS
-
AVCC
V
*1: Conversion time is the value of sampling time(Ts) + compare time(Tc).
The condition of the minimum conversion time is when HCLK=72MHz, the value of sampling time: 0.222μs,
the value of sampling time: 778ns (AVcc ≥ 4.5V)
Ensure that it satisfies the value of sampling time(Ts) and compare clock cycle (Tcck).
For setting of sampling time and compare clock cycle, see chapter "12-bit A/D Converter" in "Peripheral
Manual"
ADC register is set at APB bus clock timing. Sampling and compare clock is set at Base clock (HCLK).
*2: A necessary sampling time changes by external impedance.
Ensure that it set the sampling time to satisfy (Equation 1)
*3: Compare time (Tc) is the value of (Equation 2)
DS706-00024-1v0-E
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