TAS5508BPAGR 进口原装现货，价格优势。

型号：
TAS5508BPAGR
厂家：
TI
批号：
1136+
封装：
TQFP64

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产品信息

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数字音频的1Introduction1.1FeaturesTAS5508B8通道PWM ProcessorSLES162B的 - 2005年12月 - 2006年REVISED APRIL ?音频处理一般特点48位处理架构， 76位为大多数音频ProcessingControl InterfaceFeatures I2C一个易于Useof的精密的自动化操作，控制从串行接口音量控制范围36 dB到-109 dB的集成的调幅干扰避税?主音量控制范围为18 dBCircuitryto -109分贝单， 3.3 V电源?八个独立通道音量控制64针TQFP PackageRanges 18分贝-109分贝- 5 -V容限输入可编程软音量和静音?音频输入/ OutputUpdate价格自动主时钟速率和四个低音和高音控制WithData采样率检测±18分贝范围，可选择的角八串行音频输入ChannelsFrequencies的，二阶道八PWM音频输出通道?L ，R和CConfigurable的六通道立体声? LS ， RSLineout或八通道? LR ， RR线路输出一个PWM输出驱动一个? SubExternal的差分输入操作配置的响度CompensationAmplifier的，两个耳机PWM输出的动态范围压缩机驱动anTwo阈值，两个偏移，等ThreeExternal差分放大器每通道PWM输出支持theSlopesTPA112七二阶滤波器单端和全8× 8输入纵横混合器。 EachBridge绑LoadsSignal处理通道输入可以BE - 32 - ， 38 - ， 44.1- ， 48 - ， 88.2 - ， 96 - ， 176.4 ，比8个输入andAny Channels.192 kHz的采样率， 8× 2输出搅拌机，通道1-6 。每个数据格式： 16 - ，20 - ，或24 BitOutput的是一种混合的任何TwoLeft对齐，I2S或右对齐输入信号处理通道。 IsDataRecommended使用直通-64- FS位时钟Rateoutput搅拌机Configuration. - 128 ， 192 - ， 256 - ， 384 - ， 512 - 和768- FS -8 × 3输出混音器，通道7和8 。 EachMaster时钟速率（最大ofOutput是混合任何Three50兆赫）信号处理通道。，它IsRecommended使用通ThroughOutput搅拌机Configuration.三系数设置存储DeviceCan上可手动或自动选择（基于特定数据速率）。 DC阻塞过滤器能够支持多种的BassManagement算法在数字音频的DescriptionsTAS5508B8通道2.1.3Terminal PWM ProcessorSLES162B的 - 2005年12月 - 四月修订2006TERMINAL5 Vtype域（ 1）终止（2） DESCRIPTIONTOLERANTNAMENO.AVDD_PLL9P3.3 - V模拟电源PLL 。这个终端可以连接到用于驱动功率终端DVDD的samepower源，但实现低PLL抖动，这个终端应该绕过一个0.1 μF低ESRcapacitor.AVSS5 ， 6PAnalog groundAVSS_PLL8PAnalog地面PLL AVSS_PLL 。此终端应参照同的地面asterminal DVSS ，但在这个终端必须最小化，以实现低PLL抖动，地面噪声。 AVSS终端的可用性允许，设计师useoptimizing技术，如星形接地连接，独立的地平面，或其他安静地分布技术，实现一个安静的的地面referenceat这个terminal.BKND_ERR37DIPullupActive低。后端误差序列产生运用逻辑低thisterminal 。 BKND_ERR结果没有改变任何系统参数，一切的H桥驱动器信号硬静音状态（ M态）。 DVDD15 ， 36P3.3的-V的数字电源。建议安装去耦电容of0.1μF和10μF靠近该引脚（见应用原理图）。 DVDD_PWM54P3.3 - V数字电源，34， PDigital ground35 /选择38DVSS_PWM53PDigital地面PWMHP_SEL12DI5 VPullupHeadphone PWMDVSS16 。当一个逻辑低，：耳机isselected （扬声器是关闭的）。当一个逻辑高电平选择，音箱（耳机）。 LRCLK26DI5的音频VSerial数据左/右时钟（采样率时钟） MCLK63DI5 VPulldownMCLK是一个3.3 - V主时钟输入。这个时钟的输入频率范围4 MHz到50 MHz.MUTE14DI5 VPullupSoft静音输出，低电平有效（静音信号=逻辑低，正常运行=逻辑高）。提供一个无声的静音控制音量坡道到silence.Releasing静音提供了一个无声的斜坡上volume.OSC_CAP18AOOscillator capacitorPDN13DI5 VPullupPower下来，低电平有效。 PDN权力关闭所有逻辑和停止所有应用clockswhenever逻辑低。内部参数保存througha掉电复位周期，只要不活跃。从掉电为systemrecovery时间为100 ms.PLL_FLT_RET2AOPLL外部滤波器returnPLL_FLTM3AOPLL负输入。连接到通过一个RC networkPLL_FLTP4AIPLL的正输入PLL_FLT_RET 。连接PLL_FLT_RET通过一个的RC networkPSVC32OPower供应量控制PWM outputPWM_HPML59DOPWM左声道耳机（差分 - 差分） PWM_HPMR61DOPWM右声道耳机（差分 - ） PWM_HPPL60DOPWM左声道耳机（ + ） PWM_HPPR62DOPWM的右声道耳机（差分） PWM_M_140DOPWM 1差分输出（差分 - ） PWM_M_242DOPWM 2个输出（差分 - ） PWM_M_344DOPWM 3输出（差分 - ） PWM_M_446DOPWM 4输出（ - ）（ LINEOUT L）的5 PWM_M_555DOPWM输出（差分 - ） PWM_M_657DOPWM 6输出（ LINEOUT R）（差分 - ） PWM_M_749DOPWM 7输出（差分 - ） PWM_M_851DOPWM 8个输出（差分 - ） PWM_P_141DOPWM 1输出（差分+ ） PWM_P_243DOPWM的2个输出（差分+ ） PWM_P_345DOPWM的3个输出（差分+ ）

公司介绍

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