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参数资料
| 型号： | 71M6542F-IGT/F |
| 厂商： | Maxim Integrated |
| 文件页数： | 145/166页 |
| 文件大小： | 0K |
| 描述： | IC ENERGY METERING |
| 标准包装： | 90 |
| 系列： | * |
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71M6541D/F/G and 71M6542F/G Data Sheet
6.4.9
2.5 V Voltage Regulator – Battery Power
Unless otherwise specified, V3P3SYS = V3P3A = 0, PB=GND (BRN).
Table 104: Low-Power Voltage Regulator Performance Specifications
Parameter
V2P5
V2P5 load regulation
Voltage Overhead 2V ? VBAT -VDD
Condition
VBAT = 3.0 V - 3.8 V,
V3P3 = 0 V, I LOAD = 0 mA
VBAT = 3.3 V, V3P3 = 0 V,
I LOAD = 0 mA to 1 mA
I LOAD = 0ma, VBAT = 2.0 V,
V3P3 = 0 V.
Min
2.55
Typ
2.65
Max
2.75
40
200
Unit
V
mV
mV
6.4.10 Crystal Oscillator
Measurement conditions: Crystal disconnected, test load of 200 pF/100 k Ω between XOUT and GNDD.
Table 105: Crystal Oscillator Performance Specifications
Parameter
Maximum Output Power to Crystal
Condition
Crystal connected, see note 1
Min
Typ
Max
1
Unit
μW
XIN to XOUT Capacitance
(see note 1)
RTCA_ADJ = 7F to 0,
3
pF
Capacitance change on XOUT
Bias voltage = unbiased
15
pF
Vpp = 0.1 V
Notes:
1. Guaranteed by design; not production tested.
6.4.11 Phase-Locked Loop (PLL)
Table 106: PLL Performance Specifications
Parameter
PLL Power up Settling Time
(see note 1)
Condition
PLL_FAST = 0, V3P3 = 0 V to 3.3 V
step, measured from first edge of
MCK
Min
Typ
Max
5
Unit
ms
PLL_FAST settling time
V3P3 = 0 V, VBAT = 3.8 V to 2.0 V
PLL_FAST rise (see note 1)
PLL_FAST fall (see note 1)
5
5
ms
ms
PLL SLP to MSN Settling Time
(see note 2)
PLL power up overshoot
(see note 1)
PLL_FAST = 0
PLL_FAST = 0
5
2.5
ms
MHz
Notes:
1. Guaranteed by design; not production tested.
Rev 4
145
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