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参数资料
| 型号： | 74AHC74PWDH |
| 厂商： | NXP SEMICONDUCTORS |
| 元件分类： | 通用总线功能 |
| 英文描述： | Dual D-type flip-flop with set and reset; positive-edge trigger |
| 中文描述： | AHC SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14 |
| 封装： | PLASTIC, TSSOP-14 |
| 文件页数： | 8/20页 |
| 文件大小： | 92K |
| 代理商： | 74AHC74PWDH |
1999 Sep 23
8
Philips Semiconductors
Product specification
Dual D-type flip-flop with set and reset;
positive-edge trigger
74AHC74; 74AHCT74
AC CHARACTERISTICS
Type 74AHC74
GND = 0 V; t
r
= t
f
≤
3.0 ns.
SYMBOL
PARAMETER
TEST CONDITIONS
T
amb
(
°
C)
UNIT
WAVEFORMS
C
L
25
40 to +85
40 to +125
MIN.
TYP.
MAX. MIN. MAX.
MIN.
MAX.
V
CC
= 3.0 to 3.6 V;
note 1
t
PHL
/t
PLH
propagation delay
nCP to nQ, nQ
propagation delay
nS
D
nR
D
to nQ, nQ
maximum clock
pulse frequency
propagation delay
nCP to nQ, nQ
propagation delay
nS
D
nR
D
to nQ, nQ
clock pulse width
HIGH or LOW
set or reset pulse
width LOW
removal time set or
reset
set-up time
nD to nCP
hold time
nD to nCP
maximum clock
pulse frequency
see Figs 6 and 8
15 pF
5.2
11.9
1.0
14.0
1.0
15.0
ns
see Figs 7 and 8
5.4
12.3
1.0
14.5
1.0
15.5
ns
f
max
80
125
45
45
ns
t
PHL
/t
PLH
see Figs 6 and 8
50 pF
7.4
15.4
1.0
17.5
1.0
19.5
ns
see Figs 7 and 8
7.7
15.8
1.0
18.0
1.0
20.0
ns
t
W
see Figs 6 and 8
6.0
7.0
7.0
ns
see Figs 7 and 8
6.0
7.0
7.0
ns
t
rem
5.0
5.0
5.0
ns
t
su
see Figs 6 and 8
6.0
7.0
7.0
ns
t
h
0.5
0.5
0.5
ns
f
max
50
75
70
70
ns
相关PDF资料 |
PDF描述 |
|---|---|
| 74AHCT74PWDH | Dual D-type flip-flop with set and reset; positive-edge trigger |
| 74AHCT74 | Dual D-type flip-flop with set and reset; positive-edge trigger(带置位和复位的双D触发器；上升沿触发；) |
| 74AHC86 | Quad 2-input EXCLUSIVE-OR gate(四2输入异或门) |
| 74AHCT86 | Quad 2-input EXCLUSIVE-OR gate(四2输入异或门) |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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