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参数资料
| 型号： | 74HC4020N,652 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 5/7页 |
| 文件大小： | 0K |
| 描述： | IC 14STAGE BINARY RIPPLE 16-DIP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 1,000 |
| 系列： | 74HC |
| 逻辑类型： | 二进制计数器 |
| 方向： | 上 |
| 元件数： | 1 |
| 每个元件的位元数： | 14 |
| 复位： | 异步 |
| 计数速率： | 109MHz |
| 触发器类型： | 负边沿 |
| 电源电压： | 2 V ~ 6 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 16-DIP（0.300"，7.62mm） |
| 供应商设备封装： | 16-DIP |
| 包装： | 管件 |
| 其它名称： | 95474HC4020N652-CHP |
1998 Jul 08
5
Philips Semiconductors
Product specication
Hex D-type ip-op with reset; positive-edge trigger
74HC/HCT174
DC CHARACTERISTICS FOR 74HC
For the DC characteristics see
“74HC/HCT/HCU/HCMOS Logic Family Specifications”.
Output capability: standard
ICC category: MSI
AC CHARACTERISTICS FOR 74HC
GND = 0 V; tr =tf = 6 ns; CL = 50 pF
SYMBOL
PARAMETER
Tamb (°C)
UNIT
TEST CONDITIONS
74HC
VCC
(V)
WAVEFORMS
+25
40 to +85
40 to +125
min.
typ.
max.
min.
max.
min.
max.
tPHL/ tPLH
propagation delay
CP to Qn
55
165
205
250
ns
2.0
Fig.6
20
33
41
50
4.5
16
28
35
43
6.0
tPHL
propagation delay
MR to Qn
44
150
190
225
ns
2.0
Fig.7
16
30
38
45
4.5
13
26
33
38
6.0
tTHL/ tTLH
output transition time
19
75
95
110
ns
2.0
Fig.6
7
15
19
22
4.5
6
13
16
19
6.0
tW
clock pulse width
HIGH or LOW
80
17
100
120
ns
2.0
Fig.6
16
6
20
24
4.5
14
5
17
20
6.0
tW
master reset pulse
width; LOW
80
12
100
120
ns
2.0
Fig.7
16
4
20
24
4.5
14
3
17
20
6.0
trem
removal time
MR to CP
5
11
5
ns
2.0
Fig.7
5
4
5
4.5
5
3
5
6.0
tsu
set-up time
Dn to CP
60
6
75
90
ns
2.0
Fig.8
12
2
15
18
4.5
10
2
13
15
6.0
th
hold time
Dn to CP
3
6
3
ns
2.0
Fig.8
3
2
3
4.5
3
2
3
6.0
fmax
maximum clock pulse
frequency
6
30
5
4
MHz
2.0
Fig.6
30
90
24
20
4.5
35
107
28
24
6.0
相关PDF资料 |
PDF描述 |
|---|---|
| 74LVX132MTC | IC GATE NAND QUAD 2 SCHM 14TSSOP |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| 74HC4020PW118 | 制造商:NXP 功能描述: 制造商:NXP Semiconductors 功能描述: |
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