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参数资料
| 型号： | 74HC4024DB,118 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 2/19页 |
| 文件大小： | 0K |
| 描述： | IC 7STAGE BINARY RIPPLE 14SSOP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 2,000 |
| 系列： | 74HC |
| 逻辑类型： | 二进制计数器 |
| 方向： | 上 |
| 元件数： | 1 |
| 每个元件的位元数： | 7 |
| 复位： | 异步 |
| 计数速率： | 90MHz |
| 触发器类型： | 负边沿 |
| 电源电压： | 2 V ~ 6 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 14-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 14-SSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 74HC4024DB-T 74HC4024DB-T-ND 935189980118 |
74HC4024
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NXP B.V. 2013. All rights reserved.
Product data sheet
Rev. 7 — 31 October 2013
10 of 19
NXP Semiconductors
74HC4024
7-stage binary ripple counter
[1]
tpd is the same as tPLH and tPHL.
[2]
tt is the same as tTHL and tTLH.
[3]
CPD is used to determine the dynamic power dissipation (PD in W).
PD =CPD VCC2 fi N+ (CL VCC2 fo) where:
fi = input frequency in MHz;
fo = output frequency in MHz;
CL = output load capacitance in pF;
VCC = supply voltage in V;
N = number of inputs switching;
(C
L VCC
2
f
o) = sum of outputs.
12. Waveforms
fmax
maximum frequency
CP; see Figure 6
VCC = 2.0 V
4.0
--MHz
VCC = 4.5 V
20
--MHz
VCC = 6.0 V
24
--MHz
Table 7.
Dynamic characteristics …continued
GND = 0 V; tr =tf =6 ns; CL = 50 pF; see Figure 7.
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
Also showing the master reset (MR) pulse width, the master reset to output (Qn) propagation delays and the master reset to
clock (CP) recovery time.
VM = 0.5 VI.
Fig 6.
Waveforms showing the clock (CP) to output (Qn) propagation delays, the clock pulse width, the output
transition times and the maximum clock frequency
MR input
CP input
Q0 or Qn
output
tW
tPHL
1/fmax
trec
VM
001aab910
tPLH
tW
tTLH
tTHL
tPHL
VM
90 %
10 %
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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