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参数资料
| 型号： | 74HCT193DB,112 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 11/30页 |
| 文件大小： | 0K |
| 描述： | IC SYNC 4BIT UP/DWN COUNT 16SSOP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 78 |
| 系列： | 74HCT |
| 逻辑类型： | 二进制计数器 |
| 方向： | 上，下 |
| 元件数： | 1 |
| 每个元件的位元数： | 4 |
| 复位： | 异步 |
| 计时： | 同步 |
| 计数速率： | 43MHz |
| 触发器类型： | 正边沿 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 16-SSOP |
| 包装： | 管件 |
| 其它名称： | 568-2799-5 935189730112 |
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74HC_HCT193
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Product data sheet
Rev. 4 — 24 June 2013
19 of 30
NXP Semiconductors
74HC193; 74HCT193
Presettable synchronous 4-bit binary up/down counter
Measurement points are given in Table 10.
tPLH and tPHL are the same as tpd.
Logic levels VOL and VOH are typical output voltage levels that occur with the output load.
Fig 11. The parallel load input (PL) and data (Dn) to Qn output propagation delays and PL removal time to clock
input (CPU, CPD)
001aag415
Dn input
VI
GND
VI
GND
VI
GND
VOH
VOL
Qn output
CPU, CPD
input
PL input
VM
tW
trec
tPLH
tPHL
Measurement points are given in Table 10.
tPLH and tPHL are the same as tpd.
Logic levels VOL and VOH are typical output voltage levels that occur with the output load.
Fig 12. The master reset input (MR) pulse width, MR to Qn propagation delays, MR to CPU, CPD removal time and
output transition times
001aag416
MR input
Qn output
VOH
VOL
VI
GND
VI
GND
CPU, CPD
input
VM
10 %
90 %
trec
tPHL
tTHL
tW
tTLH
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