参数资料
型号: 74LV273D,112
厂商: NXP Semiconductors
文件页数: 10/12页
文件大小: 0K
描述: IC OCT D F-F POS-EDG TRIG 20SOIC
产品培训模块: Logic Packages
标准包装: 1,520
系列: 74LV
功能: 主复位
类型: D 型总线
输出类型: 非反相
元件数: 1
每个元件的位元数: 8
频率 - 时钟: 20MHz
延迟时间 - 传输: 20ns
触发器类型: 正边沿
输出电流高,低: 12mA,12mA
电源电压: 1 V ~ 5.5 V
工作温度: -40°C ~ 125°C
安装类型: 表面贴装
封装/外壳: 20-SOIC(0.295",7.50mm 宽)
包装: 管件
Philips Semiconductors
Product specification
74LV273
Octal D-type flip-flop with reset; positive edge-trigger
1998 May 29
7
AC WAVEFORMS
VM = 1.5V at VCC w 2.7V v 3.6V
VM = 0.5V * VCC at VCC t 2.7V and w 4.5V
VOL and VOH are the typical output voltage drop that occur with the
output load.
VM
1/fMAX
tw
tPHL
tPLH
CP INPUT
Qn OUTPUT
SV00370
GND
VOH
VOL
VI
Figure 1. The clock (CP) to output (Qn) propagation delays, the
clock pulse width and the maximum clock pulse frequency
VM
MR INPUT
Qn OUTPUT
tw
tPHL
trem
CP INPUT
SV00372
VI
GND
VI
GND
VOH
VOL
VM
Figure 2. The master reset (MR) pulse width, the master reset
to output (Qn) propagations delay and the master reset to clock
(CP) removal time
Qn OUTPUT
t
su
t
su
CP INPUT
Dn INPUT
VM
th
VM
th
VI
GND
VI
GND
VOH
VOL
SV00371
Figure 3.
Data set-up and hold times for the data input (Dn)
NOTE:
The shaded areas indicate when the input is permitted to change for
predictable output performance.
TEST CIRCUIT
PULSE
GENERATOR
RT
Vl
D.U.T.
VO
CL
RL= 1k
Vcc
Test Circuit for Outputs
DEFINITIONS
VCC
VI
< 2.7V
2.7–3.6V
VCC
2.7V
TEST
tPLH/tPHL
≥ 4.5 V
VCC
RL = Load resistor
CL = Load capacitance includes jig and probe capacitiance
50pF
RT = Termination resistance should be equal to ZOUT of pulse generators.
SV00902
Figure 4.
Load circuitry for switching times
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PDF描述
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