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参数资料
| 型号： | 74LV393DB,112 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 10/12页 |
| 文件大小： | 0K |
| 描述： | IC DUAL 4BIT BINARY RIPPL 14SSOP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 78 |
| 系列： | 74LV |
| 逻辑类型： | 二进制计数器 |
| 方向： | 上 |
| 元件数： | 2 |
| 每个元件的位元数： | 4 |
| 复位： | 异步 |
| 计数速率： | 20MHz |
| 触发器类型： | 负边沿 |
| 电源电压： | 1 V ~ 3.6 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 14-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 14-SSOP |
| 包装： | 管件 |
| 其它名称： | 568-2966-5 935198240112 |
Philips Semiconductors
Product specification
74LV393
Dual 4-bit binary ripple counter
1998 Jun 10
7
AC WAVEFORMS
VM = 1.5V at VCC w 2.7V
VM = 0.5 * VCC at VCC t 2.7V
VOL and VOH are the typical output voltage drop that occur with the
output load.
SV00678
VM
nCP INPUT
VCC
GND
VOH
VOL
nQn OUTPUT
VM
tPLH
tPHL
1/fmax
Figure 1. Clock (nCP) to output (1Qn, 2Qn) propagation delays,
the clock pulse width, and the maximum clock frequency
SV00679
VM
nMR INPUT
nCP INPUT
VCC
GND
VOL
VOH
nQn OUTPUT
VM
trem
tPHL
tW
Figure 2. Master reset (nMR) pulse width,
the master reset to output (Qn) propagation delays,
and the master reset to clock (nCP) removal time
TEST CIRCUIT
PULSE
GENERATOR
RT
VI
D.U.T.
VO
CL
RL = 1k
VCC
Test Circuit for switching times
DEFINITIONS
VCC
VI
< 2.7V
VCC
TEST
tPLH/tPHL
RT = Termination resistance should be equal to ZOUT of pulse generators.
50pF
SV00901
RL = Load resistor
CL = Load capacitance includes jig and probe capacitance
2.7–3.6V
2.7V
Figure 3. Load circuitry for switching times
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| 74LV393N,112 | 功能描述:计数器 IC DUAL 4-BIT BINARY RoHS:否 制造商:NXP Semiconductors 计数器类型:Binary Counters 逻辑系列:74LV 位数:10 计数法: 计数顺序: 工作电源电压:1 V to 5.5 V 工作温度范围:- 40 C to + 125 C 封装 / 箱体:SOT-109 封装:Reel |
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