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参数资料
| 型号： | 74LVC1G02GV,125 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 1/19页 |
| 文件大小： | 0K |
| 描述： | IC GATE NOR SGL 2INPUT SC-74A |
| 产品培训模块： | Logic Packages |
| 标准包装： | 3,000 |
| 系列： | 74LVC |
| 逻辑类型： | 或非门 |
| 电路数： | 1 |
| 输入数： | 2 |
| 电源电压： | 1.65 V ~ 5.5 V |
| 电流 - 静态（最大值）： | 200µA |
| 输出电流高，低： | 32mA，32mA |
| 逻辑电平 - 低： | 0.7 V ~ 0.8 V |
| 逻辑电平 - 高： | 1.7 V ~ 2 V |
| 额定电压和最大 CL 时的最大传播延迟： | 1.7ns @ 5V，50pF |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 供应商设备封装： | 5-TSOP |
| 封装/外壳： | SC-74A，SOT-753 |
| 包装： | 带卷 (TR) |
1.
General description
The 74LVC1G02 provides the single 2-input NOR function.
Input can be driven from either 3.3 V or 5 V devices. These features allow the use of
these devices in a mixed 3.3 V and 5 V environment.
Schmitt-trigger action at all inputs makes the circuit tolerant for slower input rise and fall
time.
This device is fully specified for partial power-down applications using IOFF.
The IOFF circuitry disables the output, preventing the damaging backflow current through
the device when it is powered down.
2.
Features and benefits
Wide supply voltage range from 1.65 V to 5.5 V
High noise immunity
Complies with JEDEC standard:
JESD8-7 (1.65 V to 1.95 V)
JESD8-5 (2.3 V to 2.7 V)
JESD8-B/JESD36 (2.7 V to 3.6 V)
24 mA output drive (V
CC =3.0 V)
CMOS low power consumption
Latch-up performance exceeds 250 mA
Direct interface with TTL levels
Inputs accept voltages up to 5 V
Multiple package options
ESD protection:
HBM JESD22-A114F exceeds 2000 V
MM JESD22-A115-A exceeds 200 V
Specified from
40 Cto+85 C and 40 C to +125 C
74LVC1G02
Single 2-input NOR gate
Rev. 11 — 29 June 2012
Product data sheet
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PDF描述 |
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