参数资料
型号: 74VHCT573AMTC
厂商: Fairchild Semiconductor
文件页数: 5/9页
文件大小: 0K
描述: IC LATCH OCTAL D 3STATE 20TSSOP
标准包装: 73
系列: 74VHCT
逻辑类型: D 型透明锁存器
电路: 8:8
输出类型: 三态
电源电压: 4.5 V ~ 5.5 V
独立电路: 1
延迟时间 - 传输: 5.1ns
输出电流高,低: 8mA,8mA
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 20-TSSOP(0.173",4.40mm 宽)
供应商设备封装: 20-TSSOP
包装: 管件
其它名称: 74VHCT573AMTC-ND
74VHCT573AMTCFS
74VHCT573A
Octal
D-T
ype
Latc
h
with
3-ST
A
TE
Outputs
1997 Fairchild Semiconductor Corporation
www.fairchildsemi.com
74VHCT573A Rev. 1.3
5
AC Electrical Characteristics
Notes:
7. Parameter guaranteed by design. tOSLH = |tPLH max – tPLH min|; tOSHL = |tPHL max – tPHL min|
8. CPD is defined as the value of the internal equivalent capacitance which is calculated from the operating
current consumption without load. Average operating current can be obtained by the equation:
ICC (Opr.) = CPD VCC fIN + ICC / 8 (per F/F). The total CPD when n pcs. of the Latch operates can be
calculated by the equation: CPD(total) = 14 + 13n.
AC Operating Requirements
Symbol
Parameter
VCC (V)
Conditions
TA = +25°C
TA = –40°C
to +85°C
Units
Min.
Typ. Max. Min. Max.
tPLH, tPHL
Propagation Delay
Time (LE to On)
5.0 ± 0.5
CL = 15pF
7.7
12.3
1.0
13.5
ns
CL = 50pF
8.5
13.3
1.0
14.5
tPLH, tPHL
Propagation Delay
Time (D to On)
5.0 ± 0.5
CL = 15pF
5.1
8.5
1.0
9.5
ns
CL = 50pF
5.9
9.5
1.0
10.5
tPZL, tPZH
3-STATE Output
Enable Time
5.0 ± 0.5 RL = 1k CL = 15pF
6.3
10.9
1.0
12.5
ns
CL = 50pF
7.1
11.9
1.0
13.5
tPLZ, tPHZ
3-STATE Output
Disable Time
5.0 ± 0.5 RL = 1k CL = 50pF
8.8
11.2
1.0
12.0
ns
tOSLH, tOSHL Output to Output
Skew
5.0 ± 0.5 (7)
1.0
ns
CIN
Input Capacitance
VCC = Open
4
10
pF
COUT
Output Capacitance
VCC = 5.0V
6
pF
CPD
Power Dissipation
Capacitance
(8)
25
pF
Symbol
Parameter
VCC (V)
TA = +25°C
TA = –40°C to +85°C
Units
Min.
Typ.
Max.
Min.
Max.
tW(H)
Minimum Pulse Width (LE)
5.0 ± 0.5
6.5
8.5
ns
tS
Minimum Set-Up Time
5.0 ± 0.5
1.5
ns
tH
Minimum Hold Time
5.0 ± 0.5
3.5
ns
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