参数资料
| 型号： | A1440A-1VQG100I |
| 厂商： | Microsemi SoC |
| 文件页数： | 17/90页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 4K GATES 100-VQFP |
| 产品变化通告： | A1440A Family Discontinuation 24/Jan/2012 |
| 标准包装： | 90 |
| 系列： | ACT™ 3 |
| LAB/CLB数： | 564 |
| 输入/输出数： | 83 |
| 门数： | 4000 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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Detailed Specifications
2- 16
R e visio n 3
ACT 3 Timing Model
Note:
Values shown for A1425A –1 speed grade device.
Figure 2-10 Timing Model
Output Delays
Internal Delays
Input Delays
tINH = 0.0 ns
tINSU = 2.3 ns
I/O CLOCK
I/O Module
D
Q
tICKY = 6.0 ns
FIOMAX = 150 MHz
tINY = 3.6 ns
tIRD2 = 1.6 ns
Combinatorial
Logic Module
tPD = 2.6 ns
Sequential
Logic Module
I/O Module
tRD1 = 1.1 ns
tDHS = 6.4 ns
I/O Module
ARRAY
CLOCK
FHMAX = 150 MHz
Comb.
Logic
Included
in t
SUD
D
Q
D
Q
tOUTH = 0.9 ns
tOUTSU = 0.9 ns
tDHS = 6.4 ns
tENZHS = 5.1 ns
tRD1 = 1.1 ns
tCO = 2.6 ns
tSUD = 0.7 ns
tHD = 0.0 ns
tRD4 = 2.2 ns
tRD8 = 3.6 ns
Predicted
Routing
Delays
tHCKH = 3.9 ns
tCKHS = 9.0 ns
(pad-pad)
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