- 您现在的位置：买卖IC网 > PDF目录294783 > A14V40A-VQ100C FPGA, 564 CLBS, 4000 GATES, 100 MHz, PQFP100 PDF资料下载
参数资料
| 型号： | A14V40A-VQ100C |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 564 CLBS, 4000 GATES, 100 MHz, PQFP100 |
| 封装： | 1 MM HEIGHT, MO-136, VQFP-100 |
| 文件页数： | 26/68页 |
| 文件大小： | 489K |
| 代理商： | A14V40A-VQ100C |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页当前第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页
1-206
A1425A, A14V25A Timing Characteristics (continued)
(Worst-Case Commercial Conditions)
Note:
1.
Delays based on 35pF loading.
Dedicated (Hard-Wired) I/O Clock
Network
‘–3’ Speed
‘–2’ Speed
‘–1’ Speed
‘Std’ Speed
3.3V Speed
Parameter
Description
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max. Units
tIOCKH
Input Low to High
(Pad to I/O Module Input)
2.0
2.3
2.6
3.0
3.5
ns
tIOPWH
Minimum Pulse Width High
1.9
2.4
3.3
3.8
4.8
ns
tIOPWL
Minimum Pulse Width Low
1.9
2.4
3.3
3.8
4.8
ns
tIOSAPW
Minimum Asynchronous
Pulse Width
1.9
2.4
3.3
3.8
4.8
ns
tIOCKSW
Maximum Skew
0.4
ns
tIOP
Minimum Period
4.0
5.0
6.8
8.0
10.0
ns
fIOMAX
Maximum Frequency
250
200
150
125
100
MHz
Dedicated (Hard-Wired) Array Clock
Network
tHCKH
Input Low to High
(Pad to S-Module Input)
3.0
3.4
3.9
4.5
5.5
ns
tHCKL
Input High to Low
(Pad to S-Module Input)
3.0
3.4
3.9
4.5
5.5
ns
tHPWH
Minimum Pulse Width High
1.9
2.4
3.3
3.8
4.8
ns
tHPWL
Minimum Pulse Width Low
1.9
2.4
3.3
3.8
4.8
ns
tHCKSW
Maximum Skew
0.3
ns
tHP
Minimum Period
4.0
5.0
6.8
8.0
10.0
ns
fHMAX
Maximum Frequency
250
200
150
125
100
MHz
Routed Array Clock Networks
tRCKH
Input Low to High (FO=64)
3.7
4.1
4.7
5.5
9.0
ns
tRCKL
Input High to Low (FO=64)
4.0
4.5
5.1
6.0
9.0
ns
tRPWH
Min. Pulse Width High
(FO=64)
3.3
3.8
4.2
4.9
6.5
ns
tRPWL
Min. Pulse Width Low
(FO=64)
3.3
3.8
4.2
4.9
6.5
ns
tRCKSW
Maximum Skew (FO=128)
0.7
0.8
0.9
1.0
ns
tRP
Minimum Period (FO=64)
6.8
8.0
8.7
10.0
13.4
ns
fRMAX
Maximum Frequency
(FO=64)
150
125
115
100
75
MHz
Clock-to-Clock Skews
tIOHCKSW
I/O Clock to H-Clock Skew
0.0
1.7
0.0
1.8
0.0
2.0
0.0
2.2
0.0
3.0
ns
tIORCKSW
I/O Clock to R-Clock Skew
(FO = 64)
(FO = 80)
0.0
1.0
3.0
0.0
1.0
3.0
0.0
1.0
3.0
0.0
1.0
3.0
0.0
3.0
ns
tHRCKSW
H-Clock to R-Clock Skew
(FO = 64)
(FO = 80)
0.0
1.0
3.0
0.0
1.0
3.0
0.0
1.0
3.0
0.0
1.0
3.0
0.0
1.0
3.0
ns
相关PDF资料 |
PDF描述 |
|---|---|
| A14V40A-PQ160C | FPGA, 564 CLBS, 4000 GATES, 100 MHz, PQFP160 |
| A14V40A-TQ176C | FPGA, 564 CLBS, 4000 GATES, 100 MHz, PQFP176 |
| A1415A-1PL84C | FPGA, 200 CLBS, 1500 GATES, 150 MHz, PQCC84 |
| A1415A-1PLG84C | FPGA, 200 CLBS, 1500 GATES, 150 MHz, PQCC84 |
| A1415A-1PQ100C | FPGA, 200 CLBS, 1500 GATES, 150 MHz, PQFP100 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| A14V40A-VQG100C | 功能描述:IC FPGA 4K GATES 3.3V 100-VQFP RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:ACT™ 3 产品变化通告:XC4000(E,L) Discontinuation 01/April/2002 标准包装:24 系列:XC4000E/X LAB/CLB数:100 逻辑元件/单元数:238 RAM 位总计:3200 输入/输出数:80 门数:3000 电源电压:4.5 V ~ 5.5 V 安装类型:表面贴装 工作温度:-40°C ~ 100°C 封装/外壳:120-BCBGA 供应商设备封装:120-CPGA（34.55x34.55） |
| A14V60AA-1BG208B | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:Accelerator Series FPGAs - ACT 3Family |
| A14V60AA-1BG208C | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:Accelerator Series FPGAs - ACT 3Family |
| A14V60AA-1BG208I | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:Accelerator Series FPGAs - ACT 3Family |
| A14V60AA-1BG208M | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:Accelerator Series FPGAs - ACT 3Family |
发布紧急采购，3分钟左右您将得到回复。