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参数资料
| 型号： | A3P1000-1FGG484II |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 24576 CLBS, 1000000 GATES, 350 MHz, PBGA484 |
| 封装： | 23 X 23 MM, 2.23 MM HEIGHT, 1 MM PITCH, GREEN, FBGA-484 |
| 文件页数： | 44/49页 |
| 文件大小： | 5893K |
| 代理商： | A3P1000-1FGG484II |
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ProASIC3 DC and Switching Characteristics
2- 78
v1.3
Global Resource Characteristics
A3P250 Clock Tree Topology
Clock delays are device-specific. Figure 2-27 is an example of a global tree used for clock routing.
The global tree presented in Figure 2-27 is driven by a CCC located on the west side of the A3P250
device. It is used to drive all D-flip-flops in the device.
Figure 2-27 Example of Global Tree Use in an A3P250 Device for Clock Routing
Central
Global Rib
VersaTile
Rows
Global Spine
CCC
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PDF描述 |
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