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参数资料
| 型号： | A3PN125-ZVQG100I |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| 封装： | 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100 |
| 文件页数： | 12/100页 |
| 文件大小： | 3284K |
| 代理商： | A3PN125-ZVQG100I |
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ProASIC3 nano DC and Switching Characteristics
Ad vance v0.2
2-5
Thermal Characteristics
Introduction
The temperature variable in the Actel Designer software refers to the junction temperature, not
the ambient temperature. This is an important distinction because dynamic and static power
consumption cause the chip junction to be higher than the ambient temperature.
EQ 2-1 can be used to calculate junction temperature.
TJ = Junction Temperature = ΔT + TA
EQ 2-1
where:
TA = Ambient Temperature
ΔT = Temperature gradient between junction (silicon) and ambient ΔT = θ
ja * P
θ
P = Power dissipation
Package Thermal Characteristics
The device junction-to-case thermal resistivity is
θ
jc and the junction-to-ambient air thermal
resistivity is
θ
ja. The thermal characteristics for θja are shown for two air flow rates. The absolute
maximum junction temperature is 100°C. EQ 2-2 shows a sample calculation of the absolute
maximum power dissipation allowed for a 484-pin FBGA package at commercial temperature and
in still air.
EQ 2-2
Temperature and Voltage Derating Factors
Maximum Power Allowed
Max. junction temp. (
°C) Max. ambient temp. (°C)
–
θ
ja(°C/W)
---------------------------------------------------------------------------------------------------------------------------------------
100
°C70°C
–
20.5
°C/W
------------------------------------
1.463 W
=
Table 2-5
Package Thermal Resistivities
Package Type
Device
Pin Count
θ
jc
θ
ja
Units
Still Air 200 ft./min. 500 ft./min.
Quad Flat No Lead (QFN)
All devices
48
TBD
C/W
68
TBD
C/W
100
TBD
C/W
Very Thin Quad Flat Pack (VQFP)
All devices
100
10.0
35.3
29.4
27.1
C/W
Table 2-6
Temperature and Voltage Derating Factors for Timing Delays
(normalized to TJ = 70°C, VCC = 1.425 V)
Array Voltage VCC (V)
Junction Temperature (°C)
–40°C
–20°C
0°C
25°C
70°C
85°C
110°C
1.425
0.968
0.973
0.979
0.991
1.000
1.006
1.013
1.500
0.888
0.894
0.899
0.910
0.919
0.924
0.930
1.575
0.836
0.841
0.845
0.856
0.864
0.870
0.875
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PDF描述 |
|---|---|
| A3PN125-ZVQG100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3RS91.1 | 0 MHz - 3000 MHz 50 ohm RF/MICROWAVE TERMINATION |
| A404318 | 35 A, BARRIER STRIP TERMINAL BLOCK, 1 ROW, 1 DECK |
| A404317 | 35 A, BARRIER STRIP TERMINAL BLOCK, 1 ROW, 1 DECK |
| A404315 | 35 A, BARRIER STRIP TERMINAL BLOCK, 1 ROW, 1 DECK |
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参数描述 |
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