参数资料
| 型号： | A40MX02-3PL68 |
| 厂商： | Microsemi SoC |
| 文件页数： | 72/142页 |
| 文件大小： | 0K |
| 描述： | IC FPGA MX SGL CHIP 3K 68-PLCC |
| 标准包装： | 19 |
| 系列： | MX |
| 输入/输出数： | 57 |
| 门数： | 3000 |
| 电源电压： | 3 V ~ 3.6 V，4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 68-LCC（J 形引线） |
| 供应商设备封装： | 68-PLCC（24.23x24.23） |
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40MX and 42MX FPGA Families
Re vi s i on 11
1 - 31
Sequential Module Timing Characteristics
Figure 1-23 Module Delays
Note:
*D represents all data functions involving A, B, and S for multiplexed flip-flops.
Figure 1-24 Flip-Flops and Latches
S
A
B
Y
S, A or B
Y
50%
tPLH
Y
50%
tPHL
PHL
tPLH
t
WCLKA
t
WASYN
t
HD
t
SUENA
t
SUD
t
RS
t
A
t
WCLK1
t
CO
t
HENA
D*
G, CLK
E
Q
PRE, CLR
(Positive Edge-Triggered)
D
E
CLK
CLR
PRE
Y
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