参数资料
| 型号： | A54SX32-1BG329 |
| 厂商： | Microsemi SoC |
| 文件页数： | 5/64页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SX 48K GATES 329-BGA |
| 标准包装： | 27 |
| 系列： | SX |
| LAB/CLB数： | 2880 |
| 输入/输出数： | 249 |
| 门数： | 48000 |
| 电源电压： | 3 V ~ 3.6 V，4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 329-BBGA |
| 供应商设备封装： | 329-PBGA（31x31） |
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SX Family FPGAs
v3.2
1-9
PCI Compliance for the SX Family
The SX family supports 3.3 V and 5.0 V PCI and is compliant with the PCI Local Bus Specification Rev. 2.1.
Table 1-6
A54SX16P DC Specifications (5.0 V PCI Operation)
Symbol
Parameter
Condition
Min.
Max.
Units
VCCA
Supply Voltage for Array
3.0
3.6
V
VCCR
Supply Voltage required for Internal Biasing
4.75
5.25
V
VCCI
Supply Voltage for I/Os
4.75
5.25
V
VIH
Input High Voltage1
2.0
VCC + 0.5
V
VIL
Input Low Voltage1
–0.5
0.8
V
IIH
Input High Leakage Current
VIN = 2.7
70
A
IIL
Input Low Leakage Current
VIN = 0.5
–70
A
VOH
Output High Voltage
IOUT = –2 mA
2.4
V
VOL
Output Low Voltage2
IOUT = 3 mA, 6 mA
0.55
V
CIN
Input Pin Capacitance3
10
pF
CCLK
CLK Pin Capacitance
5
12
pF
CIDSEL
IDSEL Pin Capacitance4
8pF
Notes:
1. Input leakage currents include hi-Z output leakage for all bidirectional buffers with tristate outputs.
2. Signals without pull-up resistors must have 3 mA low output current. Signals requiring pull-up must have 6 mA; the latter include,
FRAME#, IRDY#, TRDY#, DEVSEL#, STOP#, SERR#, PERR#, LOCK#, and, when used, AD[63::32], C/BE[7::4]#, PAR64, REQ64#, and
ACK64#.
3. Absolute maximum pin capacitance for a PCI input is 10 pF (except for CLK).
4. Lower capacitance on this input-only pin allows for non-resistive coupling to AD[xx].
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