参数资料
| 型号： | A54SX72A-1CQ256B |
| 厂商： | Microsemi SoC |
| 文件页数： | 60/108页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SX-A 108K 256-CQFP |
| 标准包装： | 1 |
| 系列： | SX-A |
| LAB/CLB数： | 6036 |
| 输入/输出数： | 203 |
| 门数： | 108000 |
| 电源电压： | 2.25 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-BFCQFP，带拉杆 |
| 供应商设备封装： | 256-CQFP（75x75） |
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SX-A Family FPGAs
v5.3
2-35
tINYH
Input Data Pad to Y High 5 V PCI
0.7
0.8
0.9
1.0
1.4
ns
tINYL
Input Data Pad to Y Low 5 V PCI
0.9
1.1
1.2
1.4
1.9
ns
tINYH
Input Data Pad to Y High 5 V TTL
0.9
1.1
1.2
1.4
1.9
ns
tINYL
Input Data Pad to Y Low 5 V TTL
1.4
1.6
1.8
2.1
2.9
ns
Input Module Predicted Routing Delays3
tIRD1
FO = 1 Routing Delay
0.3
0.4
0.6
ns
tIRD2
FO = 2 Routing Delay
0.4
0.5
0.6
0.8
ns
tIRD3
FO = 3 Routing Delay
0.5
0.6
0.7
0.8
1.1
ns
tIRD4
FO = 4 Routing Delay
0.7
0.8
0.9
1
1.4
ns
tIRD8
FO = 8 Routing Delay
1.2
1.4
1.5
1.8
2.5
ns
tIRD12
FO = 12 Routing Delay
1.7
2
2.2
2.6
3.6
ns
Table 2-28 A54SX32A Timing Characteristics (Continued)
(Worst-Case Commercial Conditions, VCCA = 2.25 V, VCCI = 3.0 V, TJ = 70°C)
Parameter
Description
–3 Speed1
–2 Speed
–1 Speed
Std. Speed
–F Speed
Units
Min. Max. Min. Max. Min. Max. Min. Max. Min. Max.
Notes:
1. All –3 speed grades have been discontinued.
2. For dual-module macros, use tPD + tRD1 + tPDn , tRCO + tRD1 + tPDn , or tPD1 + tRD1 + tSUD , whichever is appropriate.
3. Routing delays are for typical designs across worst-case operating conditions. These parameters should be used for estimating device
performance. Post-route timing analysis or simulation is required to determine actual performance.
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