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参数资料
型号： A54SX72A-2PQG208I
厂商： Microsemi SoC
文件页数： 24/108页
文件大小： 0K
描述： IC FPGA SX-A 108K 208-PQFP
标准包装： 24
系列： SX-A
LAB/CLB数： 6036
输入/输出数： 171
门数： 108000
电源电压： 2.25 V ~ 5.25 V
安装类型： 表面贴装
工作温度： -40°C ~ 85°C
封装/外壳： 208-BFQFP
供应商设备封装： 208-PQFP（28x28）
SX-A Family FPGAs
2- 2
v5.3
Electrical Specifications
Table 2-5 3.3 V LVTTL and 5 V TTL Electrical Specifications
Symbol
Parameter
Commercial
Industrial
Min.
Max.
Min.
Max.
Units
VOH
VCCI = Minimum
VI = VIH or VIL
(IOH = –1 mA)
0.9 VCCI
V
VCCI = Minimum
VI = VIH or VIL
(IOH = –8 mA)
2.4
V
VOL
VCCI = Minimum
VI = VIH or VIL
(IOL= 1 mA)
0.4
V
VCCI = Minimum
VI = VIH or VIL
(IOL= 12 mA)
0.4
V
VIL
Input Low Voltage
0.8
V
VIH
Input High Voltage
2.0
5.75
2.0
5.75
V
IIL/IIH
Input Leakage Current, VIN = VCCI or GND
–10
10
–10
10
A
IOZ
Tristate Output Leakage Current
–10
10
–10
10
A
tR, tF
Input Transition Time tR, tF
10
ns
CIO
I/O Capacitance
10
pF
ICC
Standby Current
10
20
mA
IV Curve* Can be derived from the IBIS model on the web.
Note: *The IBIS model can be found at http://www.actel.com/download/ibis/default.aspx.
Table 2-6 2.5 V LVCMOS2 Electrical Specifications
Symbol
Parameter
Commercial
Industrial
Min.
Max.
Min.
Max.
Units
VOH
VDD = MIN,
VI = VIH or VIL
(IOH = –100 μA)
2.1
V
VDD = MIN,
VI = VIH or VIL
(IOH = –1 mA)
2.0
V
VDD = MIN,
VI = VIH or VIL
(IOH =–-2 mA)
1.7
V
VOL
VDD = MIN,
VI = VIH or VIL
(IOL= 100 μA)
0.2
V
VDD = MIN,
VI = VIH or VIL
(IOL= 1 mA)
0.4
V
VDD = MIN,
VI = VIH or VIL
(IOL= 2 mA)
0.7
V
VIL
Input Low Voltage, VOUT ≤ VVOL(max)
-0.3
0.7
-0.3
0.7
V
VIH
Input High Voltage, VOUT ≥ VVOH(min)
1.75.751.7
5.75
V
IIL/IIH
Input Leakage Current, VIN = VCCI or GND
–10
10
–10
10
A
IOZ
Tristate Output Leakage Current, VOUT = VCCI or GND
–10
10
–10
10
A
tR, tF
Input Transition Time tR, tF
10
ns
CIO
I/O Capacitance
10
pF
ICC
Standby Current
10
20
mA
IV Curve* Can be derived from the IBIS model on the web.
Note: *The IBIS model can be found at http://www.actel.com/download/ibis/default.aspx.
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