参数资料
型号: AD261BND-0
厂商: Analog Devices Inc
文件页数: 6/6页
文件大小: 0K
描述: IC LOGIC ISO/3.5KV 0:5IO 22DIP
标准包装: 1
系列: IsoLogic™
输入 - 1 侧/2 侧: 2/3
通道数: 5
电源电压: 4 V ~ 5.75 V
电压 - 隔离: 1250Vrms
数据速率: 40MBd
传输延迟: 14ns
输出类型: 三态
封装/外壳: 22-DIP 模块
供应商设备封装: 22-PDIP
包装: 管件
工作温度: -25°C ~ 85°C
AD261
Logic information is sent across the barrier as “set-hi/set-lo”
SCHMITT
TRIGGER
3.5kV
ISOLATION
DATA
OUTPUT
data that is derived from logic level transitions of the input. At
power-up or after a fault condition, an output might not repre-
sent the state of the respective channel input to the isolator. An
DATA IN
BUFFER
D Q
DRIVER
BARRIER
RECEIVER BUFFER
OUT
internal circuit operates in the background which interrogates
all inputs about every 5 μ s and in the absence of logic transi-
tions, sends appropriate “set-hi” or “set-lo” data across the
ENABLE
G
GATED
TRANSPARENT
CONTINUOUS
UPDATE CIRCUIT
ENABLE
barrier.
Recovery time from a fault condition or at power-up is thus
between 5 μ s and 10 μ s.
LATCH
Figure 1. Simplified Block Diagram
POSITIVE GOING
INPUT
OUTPUT
63%
INPUT THRESHOLD
NEGATIVE GOING
INPUT THRESHOLD
HYSTERESIS
37%
t ff
PROPAGATION DELAY
t PD = 14ns
BUFFER
DELAY LINE
BUFFER
EFFECTIVE
CIRCUIT
14ns
100
MODEL
5pF
INPUT
5pF
OUTPUT
CAPACITANCE
t rr = t ff = 100 x C TOTAL OUTPUT CAPACITANCE
0.5ns – NO LOAD
= 5.5ns INTO 50pF
CAPACITANCE
TOTAL DELAY = t PD
t rr = 13ns (NO LOAD), 18ns (50pF LOAD)
Figure 2. Typical Timing and Delay Models
OUTLINE DIMENSIONS
Dimensions shown in inches and (mm).
22-Pin Plastic DIP
(ND-22A)
1.500 (38.1) MAX
0.440
0.550 (13.97)
MAX
SIDE VIEW
(11.18)
END VIEW
1
8
15
22
MAX
0.100
0.160 (4.06)
0.140 (3.56)
0.050 (1.27)
0.020
(0.508
0.010
0.254)
(2.54)
0.350
(8.89)
16 PLACES
0.075 (1.91)
PIN 1
BOTTOM
0.250
(6.35)
SYSTEM
VIEW
0.738* (18.75)
FIELD
0.050
0.650 (16.51)
(1.27)
*CREEPAGE PATH (SUBTRACT APPROXIMATELY
0.079 (2mm) FOR SOLDER PAD RADII ON PC BOARD.
THIS SPACING SUPPORTS THE INTRINSICALLY SAFE
RATING OF 750V.
–6 –
REV. 0
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