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参数资料
| 型号： | AD5115BCPZ10-RL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 3/24页 |
| 文件大小： | 0K |
| 描述： | IC DGTL POT 32POS 10K 8LFCSP |
| 标准包装： | 3,000 |
| 接片： | 32 |
| 电阻（欧姆）： | 10k |
| 电路数： | 1 |
| 温度系数： | 标准值 35 ppm/°C |
| 存储器类型： | 非易失 |
| 接口： | 3 线串行（芯片选择，增/减） |
| 电源电压： | 2.3 V ~ 5.5 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-UFDFN 裸露焊盘，CSP |
| 供应商设备封装： | 8-LFCSP-UD（2x2） |
| 包装： | 带卷 (TR) |
Data Sheet
AD5111/AD5113/AD5115
Rev. | Page 11 of 24
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
AD5111/
AD5113/
AD5115
3
W
4
B
1
VDD
2
A
6 CLK
5 GND
TOP VIEW
(Not to Scale)
8 CS
7 U/D
09654-
006
NOTES
1. THE EXPOSED PAD IS INTERNALLY
FLOATING.
Figure 5. Pin Configuration
Table 8. Pin Function Descriptions
Pin No.
Mnemonic
Description
1
VDD
Positive Power Supply. Decouple this pin with 0.1 F ceramic capacitors and 10 F capacitors.
2
A
Terminal A of RDAC. GND ≤ VA ≤ VDD.
3
W
Wiper Terminal of RDAC. GND ≤ VW ≤ VDD.
4
B
Terminal B of RDAC. GND ≤ VB ≤ VDD.
5
GND
Ground Pin, Logic Ground Reference.
6
CLK
Clock Input. Each clock pulse executes the step-up or step-down of the resistance. The direction is determined
by the state of the U/D pin. CLK is a negative edge trigger. Data can be transferred at rates up to 50 MHz.
7
U/D
Up/Down Selection Counter Control.
8
CS
Chip Select. Active Low.
EPAD
Exposed Pad. The exposed pad is internally floating.
A
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PDF描述 |
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