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参数资料
| 型号： | AD5246BKS100-R2 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 12/16页 |
| 文件大小： | 0K |
| 描述： | IC POT DGTL 100K 128POS SC70-6 |
| 标准包装： | 1 |
| 接片： | 128 |
| 电阻（欧姆）： | 100k |
| 电路数： | 1 |
| 温度系数： | 标准值 45 ppm/°C |
| 存储器类型： | 易失 |
| 接口： | I²C |
| 电源电压： | 2.7 V ~ 5.5 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 6-TSSOP，SC-88，SOT-363 |
| 供应商设备封装： | SC-70-6 |
| 包装： | 剪切带 (CT) |
| 其它名称： | AD5246BKS100-R2CT |
Data Sheet
AD5246
Rev. C | Page 5 of 16
TIMING CHARACTERISTICS
VDD = 5 V ± 10% or 3 V ± 10%; VA = VDD; –40°C < TA < +125°C, unless otherwise noted.
Table 3.
Parameter
Symbol
Conditions
Min
Typ1
Max
Unit
SCL Clock Frequency
fSCL
400
kHz
tBUF Bus Free Time Between STOP and START
t1
1.3
s
tHD;STA Hold Time (Repeated START)
t2
After this period, the first clock pulse is
generated
0.6
s
tLOW Low Period of SCL Clock
t3
1.3
s
tHIGH High Period of SCL Clock
t4
0.6
50
s
tSU;STA Setup Time for Repeated START Condition
t5
0.6
s
tHD;DAT Data Hold Time
t6
0.9
s
tSU;DAT Data Setup Time
t7
100
ns
tF Fall Time of Both SDA and SCL Signals
t8
300
ns
tR Rise Time of Both SDA and SCL Signals
t9
300
ns
tSU;STO Setup Time for STOP Condition
t10
0.6
s
1
Typical specifications represent average readings at 25°C and VDD = 5 V.
2
Guaranteed by design; not subject to production test.
3
See timing diagrams (Figure 26, Figure 27, and Figure 28) for locations of measured values.
4
Specifications apply to all parts.
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