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参数资料
| 型号： | AD5301BRM |
| 厂商： | Analog Devices Inc |
| 文件页数： | 7/24页 |
| 文件大小： | 0K |
| 描述： | IC DAC 8BIT 2.5V 2-WIRE 8-MSOP |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 产品变化通告： | Product Discontinuance 27/Oct/2011 |
| 标准包装： | 50 |
| 设置时间： | 6µs |
| 位数： | 8 |
| 数据接口： | I²C，串行 |
| 转换器数目： | 1 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 1.4mW |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-TSSOP，8-MSOP（0.118"，3.00mm 宽） |
| 供应商设备封装： | 8-MSOP |
| 包装： | 管件 |
| 输出数目和类型： | 1 电压，单极；1 电压，双极 |
| 采样率（每秒）： | 167k |
AD5301/AD5311/AD5321
Rev. B | Page 15 of 24
WRITE OPERATION
When writing to the AD5301/AD5311/AD5321 DACs, the
user must begin with an address byte, after which the DAC
acknowledges that it is prepared to receive data by pulling
SDA low. This address byte is followed by the 16-bit word in the
form of two control bytes. The write operations for the three
SCL
SDA
SCL
SDA
LEAST SIGNIFICANT CONTROL BYTE
ACK
BY
AD5301
ACK
BY
AD5301
START
COND
BY
MASTER
*THIS BIT MUST BE 0 IN THE 6-LEAD SOT-23 VERSION.
ACK
BY
AD5301
STOP
COND
BY
MASTER
PD1
X
PD0
D7
D6
D5
D4
MOST SIGNIFICANT CONTROL BYTE
ADDRESS BYTE
0A1*
A0
00
11
R/W
D3
D2
D1
D0
X
0
09
27
-02
7
Figure 29. AD5301 Write Sequence
SCL
SDA
SCL
SDA
LEAST SIGNIFICANT CONTROL BYTE
ACK
BY
AD5311
ACK
BY
AD5311
START
COND
BY
MASTER
*THIS BIT MUST BE 0 IN THE 6-LEAD SOT-23 VERSION.
ACK
BY
AD5311
STOP
COND
BY
MASTER
PD1
X
PD0
D9
D8
D7
D6
MOST SIGNIFICANT CONTROL BYTE
ADDRESS BYTE
0A1*
A0
00
11
R/W
D5
D4
D3
D2
D1
D0
X
00
92
7-
0
28
Figure 30. AD5311 Write Sequence
SCL
SDA
SCL
SDA
LEAST SIGNIFICANT CONTROL BYTE
ACK
BY
AD5321
ACK
BY
AD5321
START
COND
BY
MASTER
*THIS BIT MUST BE 0 IN THE 6-LEAD SOT-23 VERSION.
ACK
BY
AD5321
STOP
COND
BY
MASTER
PD1
X
PD0
D11
D10
D9
D8
MOST SIGNIFICANT CONTROL BYTE
ADDRESS BYTE
0A1*
A0
00
11
R/W
D7
D6
D5
D4
D3
D2
D1
D0
00
92
7-
0
29
Figure 31. AD5321 Write Sequence
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