参数资料
| 型号： | AD5360BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 1/29页 |
| 文件大小： | 0K |
| 描述： | IC DAC 16BIT 16CH SERIAL 56LFCSP |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 设计资源： | Automated Calibration Technique That Reduces AD5360 Offset Voltage to Less Than 1 mV (CN0123) 16 Channels of Programmable Output Span Using AD5360 (CN0131) |
| 标准包装： | 1 |
| 设置时间： | 20µs |
| 位数： | 16 |
| 数据接口： | 串行 |
| 转换器数目： | 16 |
| 电压电源： | 双 ± |
| 功率耗散（最大）： | 245mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 56-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 56-LFCSP-VQ（8x8） |
| 包装： | 托盘 |
| 输出数目和类型： | 16 电压，单极；16 电压，双极 |
| 配用： | EVAL-AD5360EBZ-ND - BOARD EVAL FOR AD5360 |
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16-Channel, 16-/14-Bit,
Serial Input, Voltage-Output DAC
AD5360/AD5361
Rev. A
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www.analog.com
Fax: 781.461.3113
2007–2008 Analog Devices, Inc. All rights reserved.
FEATURES
16-channel DAC in 52-lead LQFP and 56-lead LFCSP
packages
Guaranteed monotonic to 16/14 bits
Nominal output voltage range of 10 V to +10 V
Multiple output spans available
Temperature monitoring function
Channel monitoring multiplexer
GPIO function
System calibration function allowing user-programmable
offset and gain
Channel grouping and addressing features
Data error checking feature
SPI-compatible serial interface
2.5 V to 5.5 V digital interface
Digital reset (RESET)
Clear function to user-defined SIGGNDx
Simultaneous update of DAC outputs
APPLICATIONS
Instrumentation
Industrial control systems
Level setting in automatic test equipment (ATE)
Variable optical attenuators (VOA)
Optical line cards
FUNCTIONAL BLOCK DIAGRAM
n
SERIAL
INTERFACE
8
6
n
8
14
n
n
8
14
n
SDI
SCLK
SDO
SYNC
BUSY
RESET
CLR
STATE
MACHINE
CONTROL
REGISTER
GPIO
REGISTER
GPIO
MON_OUT
MON_IN1
MON_IN0
PEC
TEMP_OUT
BIN/2SCOMP
TEMP
SENSOR
AD5360/
AD5361
A/B SELECT
REGISTER
n = 16 FOR AD5360
n = 14 FOR AD5361
A/B SELECT
REGISTER
X1 REGISTER
M REGISTER
C REGISTER
TO
MUX 2s
TO
MUX 2s
A/B
MUX
2
DAC 7
REGISTER
DAC 0
REGISTER
OFS1
REGISTER
DAC 0
REGISTER
OFS0
REGISTER
DAC 7
REGISTER
X2A REGISTER
X2B REGISTER
OFFSET
DAC 0
DAC 7
OFFSET
DAC 1
DAC 0
DAC 7
BUFFER
GROUP 0
GROUP 1
OUTPUT BUFFER
AND POWER-
DOWN CONTROL
OUTPUT BUFFER
AND POWER-
DOWN CONTROL
OUTPUT BUFFER
AND POWER-
DOWN CONTROL
OUTPUT BUFFER
AND POWER-
DOWN CONTROL
VREF0
VOUT0
VOUT1
VOUT2
VOUT3
VOUT4
VOUT5
VOUT6
VOUT8
VOUT9
VOUT10
VOUT11
VOUT12
VOUT13
VOUT14
VOUT15
VOUT7
SIGGND0
SIGGND1
VREF1
n
X1 REGISTER
M REGISTER
C REGISTER
A/B
MUX
2
X2A REGISTER
X2B REGISTER
DVCC
VDD
VSS AGND DGND
LDAC
n
X1 REGISTER
M REGISTER
C REGISTER
A/B
MUX
2
X2A REGISTER
X2B REGISTER
n
2
n
X1 REGISTER
M REGISTER
C REGISTER
A/B
MUX
2
X2A REGISTER
X2B REGISTER
MUX
VOUT0 TO
VOUT15
05
76
1-
0
07
Figure 1.
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