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参数资料
| 型号： | AD6654CBC |
| 厂商： | Analog Devices Inc |
| 文件页数： | 2/88页 |
| 文件大小： | 0K |
| 描述： | IC ADC 14BIT W/4CH RSP 256CSPBGA |
| 标准包装： | 1 |
| 位数： | 14 |
| 采样率（每秒）： | 92.16M |
| 数据接口： | 串行，并联 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 2.5W |
| 电压电源： | 模拟和数字 |
| 工作温度： | -25°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-BGA，CSPBGA |
| 供应商设备封装： | 256-CSPBGA（17x17） |
| 包装： | 托盘 |
| 输入数目和类型： | 1 个差分，单极 |
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AD6654
Rev. 0 | Page 10 of 88
MICROPORT TIMING CHARACTERISTICS
Table 8.
Temp
Test Level
Min
Typ
Max
Unit
MICROPORT CLOCK TIMING REQUIREMENTS
tCPUCLK
CPUCLK Period
Full
IV
10.0
ns
tCPUCLKL
CPUCLK Low Time
Full
IV
1.53
0.5 × tCPUCLK
ns
tCPUCLKH
CPUCLK High Time
Full
IV
1.70
0.5 × tCPUCLK
ns
INM MODE WRITE TIMING (MODE = 0)
tSC
Control3 to
↑CPUCLK Setup Time
Full
IV
0.80
ns
tHC
Control3 to
↑CPUCLK Hold Time
Full
IV
0.09
ns
tSAM
Address/Data to
↑CPUCLK Setup Time
Full
IV
0.76
ns
tHAM
Address/Data to
↑CPUCLK Hold Time
Full
IV
0.20
ns
tDRDY
↑CPUCLK to RDY (DTACK) Delay
Full
IV
3.51
6.72
ns
tACC
Write Access Time
Full
IV
3 × tCPUCLK
9 × tCPUCLK
ns
INM MODE READ TIMING (MODE = 0)
tSC
Control3 to
↑CPUCLK Setup Time
Full
IV
1.00
ns
tHC
Control3 to
↑CPUCLK Hold Time
Full
IV
0.03
ns
tSAM
Address to
↑CPUCLK Setup Time
Full
IV
0.80
ns
tHAM
Address to
↑CPUCLK Hold Time
Full
IV
0.20
ns
tDD
↑CPUCLK to Data Delay
Full
V
5.0
ns
tDRDY
↑CPUCLK to RDY (DTACK) Delay
Full
IV
4.50
6.72
ns
tACC
Read Access Time
Full
IV
3 × tCPUCLK
9 × tCPUCLK
ns
MNM MODE WRITE TIMING (MODE = 1)
tSC
Control3 to
↑CPUCLK Setup Time
Full
IV
1.00
ns
tHC
Control3 to
↑CPUCLK Hold Time
Full
IV
0.00
ns
tSAM
Address/Data to
↑CPUCLK Setup Time
Full
IV
0.00
ns
tHAM
Address/Data to
↑CPUCLK Hold Time
Full
IV
0.57
ns
tDDTACK
↑CPUCLK to DTACK (RDY) Delay
Full
IV
4.10
5.72
ns
tACC
Write Access Time
Full
IV
3 × tCPUCLK
9 × tCPUCLK
ns
MNM MODE READ TIMING (MODE = 1)
tSC
Control3 to
↑CPUCLK Setup Time
Full
IV
1.00
ns
tHC
Control3 to
↑CPUCLK Hold Time
Full
IV
0.00
ns
tSAM
Address to
↑CPUCLK Setup Time
Full
IV
0.00
ns
tHAM
Address to
↑CPUCLK Hold Time
Full
IV
0.57
ns
tDD
CPUCLK to Data Delay
Full
V
5.0
ns
tDDTACK
↑CPUCLK to DTACK (RDY) Delay
Full
IV
4.20
6.03
ns
tACC
Read Access Time
Full
IV
3 × tCPUCLK
9 × tCPUCLK
ns
1 All timing specifications are valid over the VDDCORE range of 1.7 V to 1.9 V, and the VDDIO range of 3.0 V to 3.6 V.
2 CLOAD = 40 pF on all outputs, unless otherwise noted.
3 Specification pertains to control signals: R/W, (WR), DS, (RD), and CS.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| AD6654CBCZ | 功能描述:IC ADC 14BIT W/4CH RSP 256CSPBGA RoHS:是 类别:集成电路 (IC) >> 数据采集 - 模数转换器 系列:- 产品培训模块:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 标准包装:250 系列:- 位数:12 采样率（每秒）:1.8M 数据接口:并联 转换器数目:1 功率耗散（最大）:1.82W 电压电源:模拟和数字 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:48-LQFP 供应商设备封装:48-LQFP（7x7） 包装:管件 输入数目和类型:2 个单端，单极 |
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