参数资料
型号: AD677BD
厂商: Analog Devices Inc
文件页数: 13/16页
文件大小: 0K
描述: IC ADC 16BIT SAMPLING 16-CDIP
标准包装: 1
位数: 16
采样率(每秒): 100k
数据接口: DSP,串行
转换器数目: 1
功率耗散(最大): 480mW
电压电源: 模拟和数字,双 ±
工作温度: -40°C ~ 85°C
安装类型: 通孔
封装/外壳: 16-CDIP(0.300",7.62mm)
供应商设备封装: 16-CDIP 侧面铜焊
包装: 管件
输入数目和类型: 1 个单端,双极
配用: AD677-EB-ND - BOARD EVAL SAMPLING ADC AD677
AD677
REV. A
–6–
PIN DESCRIPTION
DIP Pin
SOIC Pin
Type
Name
Description
1
SAMPLE
DI
VIN Acquisition Control Pin. Active HIGH. During conversion, SAMPLE
controls the suite of the internal sample-hold amplifier and the falling edge
initiates conversion. During calibration, SAMPLE should be held LOW. If
HIGH during calibration, diagnostic information will appear on SDATA.
2
CLK
DI
Master Clock Input. The AD677 requires 17 clock pulses to execute a
conversion. CLK is also used to derive SCLK.
3
SDATA
DO
Serial Output Data Controlled by SCLK.
4
6, 7
DGND
P
Digital Ground.
58
VCC
P
+12 V Analog Supply Voltage.
8
12
AGND
P
Analog Ground.
.9
15
AGND SENSE
AI
Analog Ground Sense.
10
16
VIN
AI
Analog Input Voltage.
11
17
VREF
AI
External Voltage Reference Input.
12
21
VEE
P
–12 V Analog Supply Voltage.
13
22, 23
VDD
P
+5 V Logic Supply Voltage.
14
26
SCLK
DO
Clock Output for Data Read, derived from CLK.
15
27
BUSY
DO
Status Line for Converter. Active HIGH, indicating a conversion or
calibration in progress.
16
28
CAL
DI
Calibration Control Pin.
6, 7
4, 5, 9, 10, 11,
NC
_
No Connection. No connections should be made to these pins.
13, 14, 18, 19,
20, 24, 25
Type: AI = Analog Input
DI = Digital Input
DO = Digital Output
P = Power
1
2
3
7
28
27
26
22
8
9
10
21
20
19
11
12
18
17
4
5
25
24
6
23
TOP VIEW
(Not to Scale)
13
14
16
15
AD677
NC = NO CONNECT
NC
AGND
CLK
SAMPLE
DGND2
NC
VCC
NC
SDATA
DGND1
NC
CAL
BUSY
VIN
VREF
NC
VEE
NC
SCLK
VDD1
VDD2
AGND
SENSE
SOIC Pinout
SAMPLE
CLK
DGND
NC
AGND
VCC
CAL
BUSY
AGND
SENSE
VIN
VEE
VDD
VREF
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
TOP VIEW
(Not to Scale)
AD677
NC = NO CONNECT
SCLK
SDATA
DIP Pinout
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