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参数资料
| 型号： | AD7147PACPZ-500R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 44/73页 |
| 文件大小： | 0K |
| 描述： | IC CAP-TO-DGTL CONV PROG 24LFCSP |
| 标准包装： | 1 |
| 系列： | CapTouch™ |
| 类型： | 电容数字转换器 |
| 分辨率（位）： | 16 b |
| 采样率（每秒）： | 250k |
| 数据接口： | 串行，SPI? |
| 电压电源： | 单电源 |
| 电源电压： | 2.6 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 24-LFCSP-VQ（4x4） |
| 包装： | 标准包装 |
| 产品目录页面： | 781 (CN2011-ZH PDF) |
| 其它名称： | AD7147PACPZ-500R7DKR |
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AD7147
Data Sheet
Rev. D | Page 48 of 72
Table 27. STAGE_COMPLETE_INT_ENABLE Register
Address
Data Bit
Default
Value
Type
Name
Description
0x007
[0]
0
R/W
STAGE0_COMPLETE_INT_ENABLE
STAGE0 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE0 conversion
[1]
0
R/W
STAGE1_COMPLETE_INT_ENABLE
STAGE1 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE1 conversion
[2]
0
R/W
STAGE2_COMPLETE_INT_ENABLE
STAGE2 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE2 conversion
[3]
0
R/W
STAGE3_COMPLETE_INT_ENABLE
STAGE3 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE3 conversion
[4]
0
R/W
STAGE4_COMPLETE_INT_ENABLE
STAGE4 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE4 conversion
[5]
0
R/W
STAGE5_COMPLETE_INT_ENABLE
STAGE5 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE5 conversion
[6]
0
R/W
STAGE6_COMPLETE_INT_ENABLE
STAGE6 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE6 conversion
[7]
0
R/W
STAGE7_COMPLETE_INT_ENABLE
STAGE7 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE7 conversion
[8]
0
R/W
STAGE8_COMPLETE_INT_ENABLE
STAGE8 conversion complete interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE8 conversion
[9]
0
R/W
STAGE9_COMPLETE_INT_ENABLE
STAGE9 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE9 conversion
[10]
0
R/W
STAGE10_COMPLETE_INT_ENABLE
STAGE10 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE10 conversion
[11]
0
R/W
STAGE11_COMPLETE_INT_ENABLE
STAGE11 conversion interrupt control
0 = interrupt source disabled
1 = INT asserted at completion of STAGE11 conversion
[12]
0
R/W
GPIO_INT_ENABLE
Interrupt control when GPIO input pin changes level
0 = disabled
1 = enabled
[15:13]
Unused
Set to 0
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参数描述 |
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