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参数资料
| 型号： | AD8111ASTZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 24/29页 |
| 文件大小： | 0K |
| 描述： | IC VIDEO CROSSPOINT SWIT 80LQFP |
| 标准包装： | 1 |
| 功能： | 视频交叉点开关 |
| 电路： | 1 x 16:8 |
| 电压电源： | 双电源 |
| 电压 - 电源，单路/双路(±)： | ±4.5 V ~ 5.5 V |
| 电流 - 电源： | 38mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 80-LQFP |
| 供应商设备封装： | 80-LQFP（12x12） |
| 包装： | 管件 |
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REV. A
AD8110/AD8111
–3–
TIMING CHARACTERISTICS (Serial)
Limit
Parameter
Symbol
Min
Typ
Max
Unit
Serial Data Setup Time
t1
20
ns
CLK Pulsewidth
t2
100
ns
Serial Data Hold Time
t3
20
ns
CLK Pulse Separation, Serial Mode
t4
100
ns
CLK to
UPDATE Delay
t5
0ns
UPDATE Pulsewidth
t6
50
ns
CLK to DATA OUT Valid, Serial Mode
t7
180
ns
Propagation Delay,
UPDATE to Switch On or Off
–
8
ns
Data Load Time, CLK = 5 MHz, Serial Mode
–
8
s
CLK,
UPDATE Rise and Fall Times
–
100
ns
RESET Time
–
200
ns
1
0
1
0
1 = LATCHED
0 = TRANSPARENT
DATA OUT
CLK
DATA IN
OUT7 (D4)
OUT7 (D3)
OUT00 (D0)
LOAD DATA INTO
SERIAL REGISTER
ON FALLING EDGE
TRANSFER DATA FROM SERIAL
REGISTER TO PARALLEL
LATCHES DURING LOW LEVEL
t2
t4
t1
t3
t7
t5
t6
UPDATE
Figure 1. Timing Diagram, Serial Mode
Table I. Logic Levels
VIH
VIL
VOH
VOL
IIH
IIL
IOH
IOL
RESET, SER/PAR
CLK, DATA IN,
CE, UPDATE
DATA OUT
CE, UPDATE
DATA OUT
2.0 V min
0.8 V max
2.7 V min
0.5 V max
20
A max
–400
A min
–400
A max 3.0 mA min
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PDF描述 |
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参数描述 |
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