参数资料
| 型号： | AD8113JSTZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 28/29页 |
| 文件大小： | 0K |
| 描述： | IC VIDEO CROSSPOINT SWIT 100LQFP |
| 标准包装： | 1 |
| 功能： | 音频/视频交叉点开关 |
| 电路： | 1 x 16:16 |
| 电压电源： | 单/双电源 |
| 电压 - 电源，单路/双路(±)： | 4.5 V ~ 5.5 V，±2.25 V ~ 6.3 V |
| 电流 - 电源： | 50mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
| 产品目录页面： | 801 (CN2011-ZH PDF) |
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REV. A
AD8113
–7–
PIN FUNCTION DESCRIPTIONS
Mnemonic
Pin Numbers
Pin Description
INxx
58, 60, 62, 64, 66, 68, 70, 72,
Analog Inputs; xx = Channel Numbers 00 through 15.
4, 6, 8, 10, 12, 14, 16, 18
DATA IN
96
Serial Data Input, TTL Compatible.
CLK
97
Clock, TTL Compatible. Falling Edge Triggered.
DATA OUT
98
Serial Data Out, TTL Compatible.
UPDATE
95
Enable (Transparent) Low. Allows serial register to connect directly to switch matrix.
Data latched when High.
RESET
100
Disable Outputs, Active Low.
CE
99
Chip Enable, Enable Low. Must be low to clock in and latch data.
SER/PAR
94
Selects Serial Data Mode, Low or Parallel Data Mode, High. Must be connected.
OUTyy
53, 51, 49, 47, 45, 43, 41, 39,
Analog Outputs yy = Channel Numbers 00 Through 15.
37, 35, 33, 31, 29, 27, 25, 23
AGND
3, 5, 7, 9, 11, 13, 15, 17, 19, 57,
Analog Ground for Inputs and Switch Matrix. Must be connected.
59, 61, 63, 65, 67, 69, 71, 73
DVCC
1, 75
5 V for Digital Circuitry.
DGND
2, 74
Ground for Digital Circuitry.
AVEE
20, 56
–5 V for Inputs and Switch Matrix.
AVCC
21, 55
5 V for Inputs and Switch Matrix.
AVCCxx/yy
54, 50, 46, 42, 38, 34, 30, 26, 22
5 V for Output Amplifier that is shared by Channel Numbers xx and yy. Must be connected.
AVEExx/yy
52, 48, 44, 40, 36, 32, 28, 24
–5 V for Output Amplifier that is shared by Channel Numbers xx and yy. Must be connected.
A0
84
Parallel Data Input, TTL Compatible (Output Select LSB).
A1
83
Parallel Data Input, TTL Compatible (Output Select).
A2
82
Parallel Data Input, TTL Compatible (Output Select).
A3
81
Parallel Data Input, TTL Compatible (Output Select MSB).
D0
80
Parallel Data Input, TTL Compatible (Input Select LSB).
D1
79
Parallel Data Input, TTL Compatible (Input Select).
D2
78
Parallel Data Input, TTL Compatible (Input Select).
D3
77
Parallel Data Input, TTL Compatible (Input Select MSB).
D4
76
Parallel Data Input, TTL Compatible (Output Enable).
NC
85–93
No Connect.
Figure 5. I/O Schematics
ESD
INPUT
VCC
AVEE
a. Analog Input
ESD
RESET
VCC
20k
DGND
c. Reset Input
ESD
OUTPUT
VCC
AVEE
b. Analog Output
ESD
INPUT
VCC
DGND
d. Logic Input
ESD
OUTPUT
VCC
2k
DGND
e. Logic Output
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