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参数资料
型号： AD8192ACPZ-RL7
厂商： Analog Devices Inc
文件页数： 22/28页
文件大小： 0K
描述： IC SW MUX HDMI/DVI 2:1 56LFCSP
标准包装： 750
功能： 开关，DVI/HDMI
电路： 1 x 2:1
电压电源： 单电源
电压 - 电源，单路/双路(±)： 3.3V，5V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 56-VFQFN 裸露焊盘，CSP
供应商设备封装： 56-LFCSP-EP（8x8）
包装： 带卷 (TR)
AD8192
Rev. 0 | Page 3 of 28
SPECIFICATIONS
TA = 27°C, AVCC = 3.3 V, VTTI = 3.3 V, VTTO = 3.3 V, DVCC = 3.3 V, AMUXVCC = 5 V, VREF_AB = 5 V, VREF_COM = 5 V,
AVEE = 0 V, DVEE = 0 V, differential input swing = 1000 mV, TMDS outputs terminated with external 50 Ω resistors to 3.3 V, unless
otherwise noted.
Table 1. TMDS Performance Specifications
Parameter
Conditions/Comments
Min
Typ
Max
Unit
TMDS DYNAMIC PERFORMANCE
Maximum Data Rate (DR) per
Channel
NRZ
2.25
Gbps
Bit Error Rate (BER)
PRBS 223 1
109
Added Data Jitter
DR
≤ 2.25 Gbps, PRBS 27 1, no equalization
23
ps (p-p)
Added Clock Jitter
1
ps (rms)
Differential Intrapair Skew
At output
1
ps
Differential Interpair Skew
At output
30
ps
TMDS EQUALIZATION PERFORMANCE
Receiver (Highest Setting)1
Boost frequency = 1.125 GHz
12
dB
Transmitter (Highest Setting)2
Boost frequency = 1.125 GHz
6
dB
TMDS INPUT CHARACTERISTICS
Input Voltage Swing
Differential
150
1200
mV
Input Common-Mode Voltage (VICM)
AVCC 800
AVCC
mV
TMDS OUTPUT CHARACTERISTICS
High Voltage Level
Single-ended high speed channel
AVCC 200
AVCC + 10
mV
Low Voltage Level
Single-ended high speed channel
AVCC 600
AVCC 400
mV
Rise/Fall Time (20% to 80%)3
DR = 2.25 Gbps
50
90
150
ps
TMDS TERMINATION
Input Termination Resistance
Single-ended
50
Ω
Output Termination Resistance
Single-ended
50
Ω
1 Output meets transmitter eye diagram as defined in the DVI Standard Revision 1.0 and HDMI Standard Revision 1.3a.
2 Cable output meets receiver eye diagram mask as defined in the DVI Standard Revision 1.0 and HDMI Standard Revision 1.3a.
3 Output rise/fall time measurement excludes external components such as HDMI connector or external ESD protection diodes. See Applications Information section for
more information.
Table 2. Auxiliary Channel Performance Specifications
Parameter
Symbol
Conditions/Comments
Min
Typ
Max
Unit
DDC CHANNELS
Input Capacitance
CAUX
DC bias = 2.5 V, ac voltage = 3.5 V p-p, f = 100 kHz
10
15
pF
Input Low Voltage
VIL
0.5
V
Input High Voltage
VIH
0.7 × VREF1
V
Output Low Voltage
VOL
IOL = 5 mA
0.4
V
Output High Voltage
VOH
VREF1
V
Rise Time
10% to 90%, no capacitive load
140
ns
Fall Time
90% to 10%, CLOAD = 400 pF
100
200
ns
Leakage
10
μA
CEC CHANNEL
Input Capacitance
CAUX
DC bias = 1.65 V, ac voltage = 2.5 V p-p, f = 100 kHz
5
25
pF
Input Low Voltage
VIL
0.8
V
Input High Voltage
VIH
2.0
V
Output Low Voltage
VOL
RPULLUP = 3 kΩ to +3.3 V
0.6
V
Output High Voltage, VOH
2.5
AVCC
V
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