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参数资料
| 型号： | AD9517-0ABCPZ-RL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 17/80页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 2.8GHZ VCO 48LFCSP |
| 标准包装： | 750 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:12 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.95GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 48-LFCSP-VQ（7x7） |
| 包装： | 带卷 (TR) |
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AD9517-0
Data Sheet
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(d
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z)
FREQUENCY (Hz)
06424-
026
Figure 31. Phase Noise (Additive) LVPECL at 245.76 MHz, Divide-by-1
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FREQUENCY (Hz)
06424-
027
Figure 32. Phase Noise (Additive) LVPECL at 200 MHz, Divide-by-5
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O
ISE
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FREQUENCY (Hz)
06424-
128
Figure 33. Phase Noise (Additive) LVPECL at 1600 MHz, Divide-by-1
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O
ISE
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z)
FREQUENCY (Hz)
06424-
142
Figure 34. Phase Noise (Additive) LVDS at 200 MHz, Divide-by-1
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PH
A
SE
N
O
ISE
(d
B
c
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z)
FREQUENCY (Hz)
06424-
130
Figure 35. Phase Noise (Additive) LVDS at 800 MHz, Divide-by-2
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
06424-
131
Figure 36. Phase Noise (Additive) CMOS at 50 MHz, Divide-by-20
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PDF描述 |
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