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参数资料
| 型号： | AD9517-0ABCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 11/80页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 2.8GHZ VCO 48LFCSP |
| 标准包装： | 1 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:12 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.95GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 48-LFCSP-VQ（7x7） |
| 包装： | 托盘 |
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Data Sheet
AD9517-0
Rev. E | Page 19 of 80
Pin No.
Input/
Output
Pin Type
Mnemonic
Description
15
O
3.3 V CMOS
SDO
Serial Control Port. Unidirectional serial data output.
16
I/O
3.3 V CMOS
SDIO
Serial Control Port. Bidirectional serial data input/output and unidirectional serial
data input.
17
I
3.3 V CMOS
RESET
Chip Reset, Active Low. This pin has an internal 30 k pull-up resistor.
18
I
3.3 V CMOS
PD
Chip Power Down, Active Low. This pin has an internal 30 k pull-up resistor.
21, 40
I
Power
VS_LVPECL
Extended Voltage 2.5 V to 3.3 V LVPECL Power Pins.
42
O
LVPECL
OUT0
LVPECL Output; One Side of a Differential LVPECL Output.
41
O
LVPECL
OUT0
LVPECL Output; One Side of a Differential LVPECL Output.
39
O
LVPECL
OUT1
LVPECL Output; One Side of a Differential LVPECL Output.
38
O
LVPECL
OUT1
LVPECL Output; One Side of a Differential LVPECL Output.
19
O
LVPECL
OUT2
LVPECL Output; One Side of a Differential LVPECL Output.
20
O
LVPECL
OUT2
LVPECL Output; One Side of a Differential LVPECL Output.
22
O
LVPECL
OUT3
LVPECL Output; One Side of a Differential LVPECL Output.
23
O
LVPECL
OUT3
LVPECL Output; One Side of a Differential LVPECL Output.
35
O
LVDS or
CMOS
OUT4 (OUT4A)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
34
O
LVDS or
CMOS
OUT4 (OUT4B)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
33
O
LVDS or
CMOS
OUT5 (OUT5A)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
32
O
LVDS or
CMOS
OUT5 (OUT5B)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
26
O
LVDS or
CMOS
OUT6 (OUT6A)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
27
O
LVDS or
CMOS
OUT6 (OUT6B)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
28
O
LVDS or
CMOS
OUT7 (OUT7A)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
29
O
LVDS or
CMOS
OUT7 (OUT7B)
LVDS/CMOS Output; One Side of a Differential LVDS Output
or a Single-Ended CMOS Output.
44
O
Current set
resistor
RSET
Resistor connected here sets internal bias currents. Nominal value = 4.12 k.
46
O
Current set
resistor
CPRSET
Resistor connected here sets CP current range. Nominal value = 5.1 k.
47
I
Reference
input
REFIN (REF2)
Along with REFIN, this is the self-biased differential input for the PLL reference.
Alternatively, this pin is a single-ended input for REF2.
48
I
Reference
input
REFIN (REF1)
Along with REFIN, this is the self-biased differential input for the PLL reference.
Alternatively, this pin is a single-ended input for REF1.
EPAD
GND
Ground. The external paddle on the bottom of the package must be connected to
ground for proper operation.
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PDF描述 |
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