参数资料
型号: AD9522-4BCPZ-REEL7
厂商: Analog Devices Inc
文件页数: 17/84页
文件大小: 0K
描述: IC CLOCK GEN 1.6GHZ VCO 64LFCSP
标准包装: 750
类型: 时钟发生器,扇出配送
PLL:
输入: CMOS,LVDS,LVPECL
输出: CMOS,LVDS
电路数: 1
比率 - 输入:输出: 2:12,2:24
差分 - 输入:输出: 是/是
频率 - 最大: 1.8GHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 64-VFQFN 裸露焊盘,CSP
供应商设备封装: 64-LFCSP-VQ(9x9)
包装: 带卷 (TR)
AD9522-4
Rev. 0 | Page 24 of 84
–100
–110
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10
1k
100
100M
1M
10M
100k
10k
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
07
22
5-
1
32
Figure 30. Additive (Residual) Phase Noise,
CLK-to-CMOS @ 250 MHz, Divide-by-4
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1k
100M
1M
10M
100k
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PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
07
22
5-
0
33
Figure 31. Phase Noise (Absolute) Clock Generation; Internal VCO @
1475 MHz; PFD = 15.36 MHz; LBW = 40 kHz; LVDS Output = 122.88 MHz
–80
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–110
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1k
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1M
10M
100k
10k
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
INTEGRATED RMS JITTER (12kHz TO 20MHz): 372fs
INTEGRATED RMS JITTER (20kHz TO 80MHz): 318fs (EXTRAPOLATED)
07
22
5-
0
34
Figure 32. Phase Noise (Absolute) Clock Cleanup; Internal VCO @ 1400 MHz;
PFD = 120 kHz; LBW = 1.84 kHz; LVDS Output = 155.52 MHz
1k
100M
1M
10M
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PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
FREQUENCY (Hz)
–80
–90
–100
–110
–120
–130
–140
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–160
07
22
5-
1
35
INTEGRATED RMS JITTER (12kHz TO 20MHz): 146fs
Figure 33. Phase Noise (Absolute), External VCXO (Toyocom TCO-2112)
@ 245.76 MHz; PFD = 15.36 MHz; LBW = 250 Hz; LVDS Output = 245.76 MHz
C2
62pF
C3
33pF
C1
240nF
C12
220nF
BYPASS
CAPACITOR
FOR LDO
R1
820
R2
390
LF
CP
BYPASS
07
22
5-
2
34
Figure 34. PLL Loop Filter Used for Clock Generation Plot (See Figure 31)
C2
1.5nF
C3
2.2nF
C1
4.7F
C12
220nF
BYPASS
CAPACITOR
FOR LDO
R1
2.1k
R2
3k
LF
CP
BYPASS
07
22
5-
2
35
Figure 35. PLL Loop Filter Used for Clock Cleanup Plot (See Figure 32)
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PDF描述
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