参数资料
| 型号： | AD9707BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 31/44页 |
| 文件大小： | 0K |
| 描述： | IC DAC TX 14BIT 175MSPS 32-LFCSP |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 标准包装： | 1 |
| 系列： | TxDAC® |
| 设置时间： | 11ns |
| 位数： | 14 |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 电压电源： | 模拟和数字 |
| 功率耗散（最大）： | 50mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP-VQ（5x5） |
| 包装： | 托盘 |
| 输出数目和类型： | 2 电流，单极 |
| 采样率（每秒）： | 175M |
| 产品目录页面： | 785 (CN2011-ZH PDF) |
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Data Sheet
AD9704/AD9705/AD9706/AD9707
Rev. B | Page 37 of 44
POWER DISSIPATION
AD9707 is dependent on several factors that include
The power supply voltages (AVDD, CLKVDD, and DVDD)
The full-scale current output, IOUTFS
The update rate, fCLOCK
The reconstructed digital input waveform
Power dissipation is directly proportional to the analog supply
current, IAVDD, and the digital supply current, IDVDD. IAVDD is equal to
to fCLOCK and increases with increasing analog output frequencies.
ratios (fOUT/fCLOCK) for various update rates with DVDD = 3.3 V.
ICLKVDD is directly proportional to fCLOCK and is higher for differential
clock operation than for single-ended operation, as shown in
Figure 84. This difference in clock current is due primarily to the
differential clock receiver, which is disabled in single-ended
clock mode.
10
9
8
7
6
5
4
3
2
1
0
12
345
I AV
DD
(m
A
)
IOUTFS (mA)
0
592
6-
080
Figure 80. IAVDD vs. IOUTFS at AVDD = 3.3 V
0
1.00
1.25
1.50
1.75
2.00
I AVD
D
(m
A
)
IOUTFS (mA)
05
92
6-
1
02
1
3
2
4
5
6
Figure 81. IAVDD vs. IOUTFS at AVDD = 1.8 V
10
9
8
7
6
5
4
3
2
1
0
0.01
0.1
1
I DVD
D
(m
A
)
fOUT/fCLOCK
05
92
6-
0
81
fCLOCK = 75MSPS
fCLOCK = 25MSPS
fCLOCK = 10MSPS
fCLOCK = 125MSPS
fCLOCK = 175MSPS
Figure 82. IDVDD vs. fOUT/fCLOCK Ratio at DVDD = 3.3 V
2.5
0
0.01
0.1
1
I DV
D
(m
A
)
fOUT/fCLOCK
05
92
6-
0
98
0.5
1.0
1.5
2.0
2.5
fCLOCK = 80MSPS
fCLOCK = 10MSPS
fCLOCK = 25MSPS
fCLOCK = 50MSPS
Figure 83. IDVDD vs. fOUT/fCLOCK Ratio at DVDD = 1.8 V
5
4
3
2
1
0
100
50
150
200
I C
L
KV
DD
(m
A
)
fCLOCK (MSPS)
DIFF
SE
05
92
6-
0
82
Figure 84. ICLKVDD vs. fCLOCK at CLKVDD = 3.3 V
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PDF描述 |
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