参数资料
型号: AD9742ARURL7
厂商: Analog Devices Inc
文件页数: 28/32页
文件大小: 0K
描述: IC DAC 12BIT 210MSPS 28-TSSOP
产品培训模块: Data Converter Fundamentals
DAC Architectures
标准包装: 1,000
系列: TxDAC®
设置时间: 11ns
位数: 12
数据接口: 并联
转换器数目: 1
电压电源: 模拟和数字
功率耗散(最大): 145mW
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 28-TSSOP(0.173",4.40mm 宽)
供应商设备封装: 28-TSSOP
包装: 带卷 (TR)
输出数目和类型: 2 电流,单极;2 电流,双极
采样率(每秒): 210M
配用: AD9742ACP-PCBZ-ND - BOARD EVAL FOR AD9742ACP
Data Sheet
AD9742
Rev. C | Page 5 of 32
Parameter
Min
Typ
Max
Unit
Multitone Power Ratio (8 Tones at 400 kHz Spacing)
fCLOCK = 78 MSPS; fOUT = 15.0 MHz to 18.2 MHz
0 dBFS Output
65
dBc
6 dBFS Output
67
dBc
12 dBFS Output
65
dBc
18 dBFS Output
63
dBc
1
Measured single-ended into 50 load.
2
Output noise is measured with a full-scale output set to 20 mA with no conversion activity. It is a measure of the thermal noise only.
3
Noise spectral density is the average noise power normalized to a 1 Hz bandwidth, with the DAC converting and producing an output tone.
DIGITAL SPECIFICATIONS
TMIN to TMAX, AVDD = 3.3 V, DVDD = 3.3 V, CLKVDD = 3.3 V, IOUTFS = 20 mA, unless otherwise noted.
Table 3.
Parameter
Min
Typ
Max
Unit
DIGITAL INPUTS1
Logic 1 Voltage
2.1
3
V
Logic 0 Voltage
0
0.9
V
Logic 1 Current
10
+10
A
Logic 0 Current
10
+10
A
Input Capacitance
5
pF
Input Setup Time (tS)
2.0
ns
Input Hold Time (tH)
1.5
ns
Latch Pulse Width (tLPW)
1.5
ns
CLK INPUTS2
Input Voltage Range
0
3
V
Common-Mode Voltage
0.75
1.5
2.25
V
Differential Voltage
0.5
1.5
V
1
Includes CLOCK pin on SOIC/TSSOP packages and CLK+ pin on LFCSP package in single-ended clock input mode.
2
Applicable to CLK+ and CLK inputs when configured for differential or PECL clock input mode.
0.1%
tS
tH
tPD
DB0–DB11
CLOCK
IOUTA
OR
IOUTB
02912-B-002
tLPW
tST
Figure 2. Timing Diagram
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