参数资料
| 型号： | AD9956YCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 30/32页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER 1.8V 48LFCSP |
| 产品培训模块： | Direct Digital Synthesis Tutorial Series (1 of 7): Introduction Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator |
| 标准包装： | 750 |
| 分辨率（位）： | 14 b |
| 主 fclk： | 3GHz |
| 调节字宽（位）： | 48 b |
| 电源电压： | 1.71 V ~ 1.96 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 48-LFCSP-VQ（7x7） |
| 包装： | 带卷 (TR) |
| 配用： | AD9956-VCO/PCBZ-ND - BOARD EVAL 14BIT 1.8V 48LFCSP AD9956/PCBZ-ND - BOARD EVAL FOR AD9956 |
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AD9956
Rev. A | Page 7 of 32
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
Latencies/Pipeline Delays7
I/O Update to DAC Frequency Change
33
SYSCLK Cycles
I/O Update to DAC Phase Change
33
SYSCLK Cycles
PS<2:0> to DAC Frequency Change
29
SYSCLK Cycles
PS<2:0> to DAC Phase Change
29
SYSCLK Cycles
I/O Update to CP_OUT Scaler Change
4
SYSCLK Cycles
I/O Update to Frequency Accumulator
Step Size Change
4
SYSCLK Cycles
I/O Update to Frequency Accumulator
Ramp Rate Change
4
SYSCLK Cycles
RF DIVIDER/CML DRIVER EQUIVALENT
INTRINSIC TIME JITTER
FIN = 414.72 MHz, FOUT = 51.84 MHz
BW = 12 kHz > 400 kHz
136
fS rms
OC1, RF Divider R = 8
FIN = 1244.16 MHz, FOUT = 155.52 MHz
BW = 12 kHz > 1.3 MHz
101
fS rms
OC3, RF Divider R = 8
FIN = 2488.32 MHz, FOUT = 622.08 MHz
BW = 12 kHz > 5 MHz
108
fS rms
OC12, RF Divider R = 4
RF DIVIDER/CML DRIVER RESIDUAL PHASE NOISE
FIN = 157.6 MHz, FOUT = 19.7 MHz
RF Divider R = 8
@ 10 Hz
115
dBc/Hz
@ 100 Hz
126
dBc/Hz
@ 1 kHz
134
dBc/Hz
@ 10 kHz
143
dBc/Hz
@ 100 kHz
150
dBc/Hz
> 1 MHz
151
dBc/Hz
FIN = 1240 MHz, FOUT = 155 MHz
RF Divider R = 8
@ 10 Hz
111
dBc/Hz
@ 100 Hz
122
dBc/Hz
@ 1 kHz
129
dBc/Hz
@ 10 kHz
138
dBc/Hz
@ 100 kHz
146
dBc/Hz
@ 1 MHz
150
dBc/Hz
>3 MHz
153
dBc/Hz
FIN = 2488MHz, FOUT = 622 MHz
RF Divider R = 4
@ 10 Hz
97
dBc/Hz
@ 100 Hz
110
dBc/Hz
@ 1 kHz
120
dBc/Hz
@ 10 kHz
126
dBc/Hz
@ 100 kHz
136
dBc/Hz
@ 1 MHz
141
dBc/Hz
>3 MHz
144
dBc/Hz
TOTAL SYSTEM TIME JITTER FOR 622 MHz CLOCK
See the Loop Measurement Condi-
tions section
12 kHz to 5 MHz Bandwidth
0.7
ps rms
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PDF描述 |
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参数描述 |
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