参数资料
| 型号： | ADF4113BRUZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 17/28页 |
| 文件大小： | 0K |
| 描述： | IC SYNTH PLL RF 4.0GHZ 16-TSSOP |
| 标准包装： | 96 |
| 类型： | 时钟/频率合成器，RF |
| PLL： | 是 |
| 输入： | CMOS，TTL |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:1 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 4GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.7 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 551 (CN2011-ZH PDF) |
| 配用： | EVAL-ADF4113HVEB1Z-ND - BOARD EVALUATION FOR ADF4113HV EVAL-ADF4113EBZ2-ND - BOARD EVAL FOR ADF4113 1750MHZ EVAL-ADF4113EBZ1-ND - BOARD EVAL FOR ADF4113 EVAL-ADF411XEBZ1-ND - BOARD EVAL FOR ADF411X NO CHIP |
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ADF4110/ADF4111/ADF4112/ADF4113
Data Sheet
Rev. F | Page 24 of 28
VDD
VP
AVDD DVDD
ADF4110
ADF4111
ADF4112
ADF4113
VP
4.7k
VCO
VCC
GND
18
18
18
100pF
RFOUT
REFIN
51
100pF
D
N
G
P
C
D
N
G
A
D
N
G
D
RFINA
RFINB
DECOUPLING CAPACITORS AND INTERFACE SIGNALS HAVE
BEEN OMITTED FROM THE DIAGRAM TO INCREASE CLARITY.
RSET
CP
CE
POWER-DOWN CONTROL
VDD
S
IN
D
GND
LOOP
FILTER
ADG701
FREFIN
1
8
7
15
16
2
6
5
9
4
3
10
03496-0-040
Figure 35. Local Oscillator Shutdown Circuit
VDD
VP
AVDD DVDD
ADF4113
VP
2.8nF
680
130pF
3.3k
19nF
M3500-2235
VCC
18
18
18
100pF
RFOUT
1000pF 1000pF
51
REFIN
MUXOUT
LOCK
DETECT
51
100pF
D
N
G
P
C
D
N
G
A
D
N
G
D
RFINA
RFINB
CE
CLK
DATA
LE
S
U
B
L
AI
R
E
S
E
L
BI
T
A
P
M
O
C-I
P
S
DECOUPLING CAPACITORS ON AVDD, DVDD, VP OF THE ADF4113
AND ON VCC OF THE M3500-2250 HAVE BEEN OMITTED FROM
THE DIAGRAM TO AID CLARITY.
RSET
CP
4.7k
12V
V_TUNE
GND
20V
1k
AD820
3k
OUT
FREFIN
3
4
9
5
6
14
2
1
8
7
15
16
03496-0-041
Figure 36. Wideband Phase-Locked Loop
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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