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参数资料
| 型号： | ADG528AKN |
| 厂商： | Analog Devices Inc |
| 文件页数： | 9/12页 |
| 文件大小： | 0K |
| 描述： | IC MULTIPLEXER 8X1 18DIP |
| 产品培训模块： | Switch Fundamentals |
| 标准包装： | 20 |
| 功能： | 多路复用器 |
| 电路： | 1 x 8:1 |
| 导通状态电阻： | 700 欧姆 |
| 电压电源： | 单/双电源 |
| 电压 - 电源，单路/双路(±)： | 10.8 V ~ 16.5 V，±10.8 V ~ 16.5 V |
| 电流 - 电源： | 600µA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 18-DIP（0.300"，7.62mm） |
| 供应商设备封装： | 18-PDIP |
| 包装： | 管件 |
REV. B
–6–
ADG528A/ADG529A
TRUTH TABLES
A2 A1 A0 EN
WR RS ON SWITCH PAIR
XXXX
1Retains Previous Switch Condition
XXXX
X
0
NONE (Address and Enable
Latches Cleared)
XXX0
0
1
NONE
0001
0
1
0011
0
1
2
0101
0
1
3
0111
0
1
4
1001
0
1
5
1011
0
1
6
1101
0
1
7
1111
0
1
8
X = Don’t Care
ADG528A
A1 A0 EN
WR RS ON SWITCH PAIR
XXX
1Retains Previous Switch Condition
XXX
X0
NONE (Address and Enable Latches
Cleared)
XX0
01
NONE
001
0
1
011
0
1
2
101
0
1
3
111
0
1
4
X = Don’t Care
ADG529A
TIMING DIAGRAMS
Figure 1.
Figure 2.
Figure 1 shows the timing sequence for latching the switch
address and enable inputs. The latches are level sensitive; there-
fore, while
WR is held low, the latches are transparent and the
switches respond to the address and enable inputs. This input
data is latched on the rising edge of
WR.
Figure 2 shows the Reset Pulse Width, tRS, and Reset Turn-off
Time, tOFF (RS).
Note: All digital input signals rise and fall times measured from
10% to 90% of 3 V. tR = tF = 20 ns.
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