参数资料
| 型号： | ADM1026EBZEVB |
| 厂商： | ON Semiconductor |
| 文件页数： | 6/55页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR ADM1026 |
| 标准包装： | 1 |
| 类型： | 温度传感器 |
| 适用于相关产品： | ADM1026 |
| 所含物品： | 评估板 |
| 其它名称： | EVAL-ADM1026EB EVAL-ADM1026EB-ND |
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ADM1026
Table 4. ELECTRICAL CHARACTERISTICS (T A = T MIN to T MAX , V CC = V MIN to V MAX , unless otherwise noted. (Note 1, 2, and 3))
Parameter
Test Conditions/Comments
Min
Typ
Max
Unit
FAN RPM-TO-DIGITAL CONVERTER (Note 6)
Accuracy
Full-scale Count
?
?
?
?
? 12
255
%
FAN0 to FAN7 Nominal Input RPM (Note 5)
Internal Clock Frequency
Divisor = 1, fan count = 153
Divisor = 2, fan count = 153
Divisor = 4, fan count = 153
Divisor = 8, fan count = 153
?
?
?
?
20
8800
4400
2200
1100
22.5
?
?
?
?
25
RPM
kHz
OPEN DRAIN O/Ps, PWM, GPIO0 to 16
Output High Voltage, V OH
High Level Output Leakage Current, I OH
Output Low Voltage, V OL
PWM Output Frequency
I OUT = 3.0 mA, V CC = 3.3 V
V OUT = V CC
I OUT = ? 3.0 mA, V CC = 3.3 V
2.4
?
?
?
?
0.1
?
75
?
1.0
0.4
?
V
m A
V
Hz
DIGITAL OUTPUTS (INT, RESETMAIN, RESETSTBY)
Output Low Voltage, V OL
RESET Pulse Width
I OUT = ? 3.0 mA, V CC = 3.3 V
?
140
?
180
0.4
240
V
ms
OPEN DRAIN SERIAL DATABUS OUTPUT (SDA)
Output Low Voltage, V OL
High Level Output Leakage Current, I OH
I OUT = –3.0 mA, V CC = 3.3 V
V OUT = V CC
?
?
?
0.1
0.4
1.0
V
m A
SERIAL BUS DIGITAL INPUTS (SCL, SDA)
Input High Voltage, V IH
Input Low Voltage, V IL
Hysteresis
2.2
?
?
?
?
500
?
0.8
?
V
V
mV
DIGITAL INPUT LOGIC LEVELS (ADD, CI, FAN 0 to 7, GPIO 0 to 16) (Note 7 and 8)
Input High Voltage, V IH
Input Low Voltage, V IL
Hysteresis (Fan 0 to 7)
V CC = 3.3 V
V CC = 3.3 V
V CC = 3.3 V
2.4
0.8
?
?
?
250
?
?
?
V
V
mV
RESETMAIN, RESETSTBY
RESETMAIN Threshold
RESETSTBY Threshold
RESETMAIN Hysteresis
RESETSTBY Hysteresis
Falling Voltage
Falling Voltage
2.89
3.01
?
?
2.94
3.05
60
70
2.97
3.10
?
?
V
V
mV
mV
DIGITAL INPUT CURRENT
Input High Current, I IH
Input Low Current, I IL
Input Capacitance, C IN
V IN = V CC
V IN = 0
–1.0
?
?
?
?
20
?
1.0
?
m A
m A
pF
EEPROM RELIABILITY
Endurance (Note 9)
Data Retention (Note 10)
100
10
700
?
?
?
kcycles
Years
SERIAL BUS TIMING
Clock Frequency, f SCLK
Glitch Immunity, t SW
Bus Free Time, t BUF
Start Setup Time, t SU; STA
See Figure 2 for All Parameters.
?
?
4.7
4.7
?
?
?
?
400
50
?
?
kHz
ns
m s
m s
http://onsemi.com
6
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