参数资料
型号: ADP1878-1.0-EVALZ
厂商: Analog Devices Inc
文件页数: 33/40页
文件大小: 0K
描述: BOARD EVAL FOR ADP1878-1.0
标准包装: 1
系列: *

Data Sheet
LAYOUT CONSIDERATIONS
The performance of a dc-to-dc converter depends highly on
how the voltage and current paths are configured on the printed
circuit board (PCB). Optimizing the placement of sensitive
analog and power components are essential to minimize output
ripple, maintain tight regulation specifications, and reduce
PWM jitter and electromagnetic interference.
ADP1878/ADP1879
Figure 86 shows the schematic of a typical ADP1878 / ADP1879
used for a high current application. Blue traces denote high current
pathways. VIN, PGND, and V OUT traces should be wide and
possibly replicated, descending down into the multiple layers.
Vias should populate, mainly around the positive and negative
terminals of the input and output capacitors, alongside the source
of Q1/Q2, the drain of Q3/Q4, and the inductor.
HIGH VOLTAGE INPUT
V IN = 12V
JP3
C PAR
53pF
C C
430pF
R C
57k?
1
C VIN
22μF
ADP1878/
ADP1879
VIN BST 14
C BST
100nF
Q1
C3
22μF
Q2
C4
22μF
C5
22μF
C6
22μF
C7
22μF
C8
N/A
C9
N/A
V OUT = 1.8V, 15A
R SNB
C21
C22
C23
C20
+ C14 TO C19
C27
C24
C25
C26
V REG
V OUT
R7 10k?
R TOP 2k?
R BOT
1k?
R RES
100k?
C2 C1
0.1μF 1μF
2
3
4
5
6
7
COMP
EN
FB
GND
RES
VREG
SW 13
DRVH 12
PGND 11
DRVL 10
PGOOD 9
SS 8
5 k?
Q3
V REG
C SS
34nF
Q4
1.0μH
+ + + +
2? 270μF 270μF 270μF 270μF
C SNB
1.5nF
+ + +
N/A N/A N/A N/A N/A
MURATA: (HIGH VOLTAGE INPUT CAPACITORS)
22μF, 25V, X7R, 1210 GRM32ER71E226KE15L
PANASONIC: (OUTPUT CAPACITORS)
270μF, SP-SERIES, 4V, 7m?, EEFUE0G271LR
INFINEON FETs:
BSC042N03MS G (LOWER SIDE)
BSC080N03MS G (UPPER SIDE)
WüRTH INDUCTORS:
1μH, 3.8m?, 16A, 7443552100
Figure 86. ADP1878 High Current Evaluation Board Schematic (Blue Traces Indicate High Current Paths)
SENSITIVE ANALOG
COMPONENTS
LOCATED FAR
FROM NOISY
POWER SECTION
SEPARATE ANALOG
GROUND PLANE FOR
COMPENSATION AND
FEEDBACK RESISTORS
OUTPUT
CAPACITORS
ARE MOUNTED
AT RIGHTMOST
AREA OF
EVALUATION
BOARD
INPUT CAPACITORS
ARE MOUNTED CLOSE
TO DRAIN OF Q1/Q2
AND SOURCE OF Q3/Q4
Figure 87. Overall Layout of the ADP1878/ADP1879 High Current Evaluation Board
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