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参数资料
| 型号： | ADP2120ACPZ-1.5-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 3/24页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC 1.5V 10LFCSP |
| 标准包装： | 1 |
| 类型： | 降压（降压） |
| 输出类型： | 固定 |
| 输出数： | 1 |
| 输出电压： | 1.5V |
| 输入电压： | 2.3 V ~ 5.5 V |
| PWM 型： | 电流模式 |
| 频率 - 开关： | 1.2MHz |
| 电流 - 输出： | 1.25A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-WFDFN 裸露焊盘，CSP |
| 包装： | 标准包装 |
| 供应商设备封装： | 10-LFCSP-WD（3x3） |
| 其它名称： | ADP2120ACPZ-1.5-R7DKR |
Data Sheet
SPECIFICATIONS
V IN = V PVIN = 3.3 V, EN = VIN, SYNC/MODE = VIN at T J = ?40°C to +125°C, unless otherwise noted.
Table 1.
ADP2119/ADP2120
Parameter
Symbol
Test Conditions/Comments
Min
Typ
Max
Unit
VIN and PVIN
VIN Voltage Range
PVIN Voltage Range
V IN
V PVIN
2.3
2.3
5.5
5.5
V
V
Quiescent Current
Shutdown Current
VIN Undervoltage Lockout Threshold
I VIN
I SHDN
UVLO
No switching, SYNC/MODE = GND
Switching, no load, SYNC/MODE = VIN
V IN = V PVIN = 5.5 V, EN = GND
V IN rising
V IN falling
2
150
680
0.3
2.2
2.1
200
900
2
2.3
μA
μA
μA
V
V
OUTPUT CHARACTERISTICS
Load Regulation 1
Load Regulation 2
Line Regulation 1
Line Regulation 2
ADP2119, I O = 0 A to 2 A
ADP2120, I O = 0 A to 1.25 A
ADP2119, I O = 1 A
ADP2120, I O = 1 A
0.08
0.08
0.05
0.05
%/A
%/A
%/V
%/V
FB
FB Regulation Voltage
FB Bias Current
V FB
I FB
V IN = 2.3 V to 5.5 V
V IN = 2.3 V to 5.5 V
0.591
0.6
0.01
0.609
0.1
V
μA
SW
High-Side On Resistance 3
Low-Side On Resistance 3
V IN = V PVIN = 3.3 V, I SW = 200 mA
V IN = V PVIN = 3.3 V, I SW = 200 mA
145
70
190
100
m?
m?
SW Peak Current Limit
High-side switch, V IN = V PVIN = 3.3 V (ADP2119)
High-side switch, V IN = V PVIN = 3.3 V (ADP2120)
2.5
1.6
3
2
3.5
2.4
A
A
SW Maximum Duty Cycle
SW Minimum On Time 4
V IN = V PVIN = 5.5 V, full frequency
V IN = V PVIN = 5.5 V, full frequency
100
100
%
ns
TRK
TRK Input Voltage Range
0
600
mV
TRK-to-FB Offset Voltage
TRK Input Bias Current
TRK = 0 mV to 500 mV
?15
+15
100
mV
nA
FREQUENCY
Oscillator Frequency
f S
1.02
1.2
1.38
MHz
SYNC/MODE
Synchronization Range
1
2
MHz
SYNC Minimum Pulse Width
SYNC Minimum Off Time
SYNC Input High Voltage
SYNC Input Low Voltage
INTEGRATED SOFT START
100
100
1.3
0.4
ns
ns
V
V
Soft Start Time
All switching frequencies
1024
Clock
cycles
PGOOD
f S = 1.2 MHz
853
μs
Power-Good Range
FB rising threshold
105
110
115
%
FB rising hysteresis
2.5
%
Power-Good Deglitch Time
FB falling threshold
FB falling hysteresis
From FB to PGOOD
85
90
2.5
16
95
%
%
Clock
cycles
PGOOD Leakage Current
PGOOD Output Low Voltage
PGOOD Output Low Resistor
V PGOOD = 5 V
I PGOOD = 1 mA
I PGOOD = 1 mA
0.1
150
150
1
200
200
μA
mV
?
Rev. A | Page 3 of 24
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