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参数资料
| 型号： | ADSP-21060LCW-160 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 36/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 32BIT 240CQFP |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | 主机接口，连接端口，串行端口 |
| 时钟速率： | 40MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 512kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 3.30V |
| 工作温度： | -40°C ~ 100°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 240-CBFQFP 裸露焊盘 |
| 供应商设备封装： | 240-CQFP（32x32） |
| 包装： | 托盘 |
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ADSP-21060/ADSP-21060L/ADSP-21062/ADSP-21062L/ADSP-21060C/ADSP-21060LC
Rev. F
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March 2008
Figure 24. Link Ports—Receive
CLKIN
LCLK
LDAT(3:0)
LACK
LCLK 1x
OR
LCLK 2x
CLKIN
LDAT(3:0)
LACK (IN)
LCLK 1x
OR
LCLK 2x
LDAT(3:0)
LACK (OUT)
THE
t
SLACH REQUIREMENT APPLIES TO THE RISING EDG E O F LCLK ONLY FO R THE FIRST NIBBLE TRANSMITTED.
CLKIN
TRANSMIT
tDLDCH
tHLDCH
tDLCLK
tLCLKTWH
tLCLKTWL
tSLACH
tHLACH
tDLACLK
tSLDCL
tHLDCL
tLCLKRWH
tDLAHC
tDLALC
LINK PORT ENABLE OR THREE-STATE TAKES EFFECT 2 CYCLES AFTER A WRITE TO A LINK PORT CONTROL REGISTER.
tENDLK
tTDLK
RECEIVE
LINK PORT ENABLE/THREE-STATE DELAY FROM INSTRUCTION
tLCLKRWL
tLCLKIW
CLKIN
tSLCK
tHLCK
LINK PORT INTERRUPT SETUP TIME
LCLK
LAST NIBBLE
TRANSMITTED
FIRST NIBBLE
TRANSMITTED
LCLK INACTIVE
(HIGH)
OUT
IN
LACK
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PDF描述 |
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| ADSP-21060LKBZ-160 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Analog Devices 功能描述: |
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