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参数资料
| 型号： | ADSP-21363BBCZ-1AA |
| 厂商： | Analog Devices Inc |
| 文件页数： | 20/60页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 333MHZ 136CSPBGA |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，SPI |
| 时钟速率： | 333MHz |
| 非易失内存： | ROM（512 kB） |
| 芯片上RAM： | 384kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 136-LFBGA，CSPBGA |
| 供应商设备封装： | 136-CSPBGA（12x12） |
| 包装： | 托盘 |
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ADSP-21362/ADSP-21363/ADSP-21364/ADSP-21365/ADSP-21366
Reset
Table 12. Reset
Parameter
Timing Requirements
Min
Unit
t WRST 1
t SRST
RESET Pulse Width Low
RESET Setup Before CLKIN Low
4 × t CK
8
ns
ns
1
Applies after the power-up sequence is complete. At power-up, the processor’s internal phase-locked loop requires no more than 100 μs while RESET is low, assuming stable
V DD and CLKIN (not including start-up time of external clock oscillator).
CLKIN
t WRST
RESET
Figure 9. Reset
Interrupts
The following timing specification applies to the FLAG0,
FLAG1, and FLAG2 pins when they are configured as IRQ0,
IRQ1, and IRQ2 interrupts.
Table 13. Interrupts
t SRST
Parameter
Timing Requirement
Min
Unit
t IPW
IRQx Pulse Width
2 × t PCLK +2
ns
INTERRUPT
INPUTS
t IPW
Figure 10. Interrupts
Rev. J |
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July 2013
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PDF描述 |
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参数描述 |
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