参数资料
| 型号： | ADSP-21368KBPZ-3A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 30/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 400MHZ 256BGA |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI |
| 时钟速率： | 400MHz |
| 非易失内存： | ROM（768 kB） |
| 芯片上RAM： | 256kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.30V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA 裸露焊盘 |
| 供应商设备封装： | 256-BGA（27x27） |
| 包装： | 托盘 |
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Rev. F
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October 2013
Table 29. Serial Ports—Internal Clock
Parameter
Min
Max
Unit
Timing Requirements
t
SFSI
1
FS Setup Before SCLK
(Externally Generated FS in Either Transmit or Receive Mode)
7ns
t
HFSI
1
FS Hold After SCLK
(Externally Generated FS in Either Transmit or Receive Mode)
2.5
ns
t
SDRI
1
Receive Data Setup Before SCLK
7
ns
t
HDRI
1
Receive Data Hold After SCLK
2.5
ns
Switching Characteristics
t
DFSI
2
FS Delay After SCLK (Internally Generated FS in Transmit Mode)
4
ns
t
HOFSI
2
FS Hold After SCLK (Internally Generated FS in Transmit Mode)
–1.0
ns
t
DFSIR
2
FS Delay After SCLK (Internally Generated FS in Receive Mode)
9.75
ns
t
HOFSIR
2
FS Hold After SCLK (Internally Generated FS in Receive Mode)
–1.0
ns
t
DDTI
2
Transmit Data Delay After SCLK
3.25
ns
t
HDTI
2
Transmit Data Hold After SCLK
–1.0
ns
t
SCLKIW
3
Transmit or Receive SCLK Width
2 × t
PCLK – 1.5
2 × t
PCLK + 1.5
ns
1 Referenced to the sample edge.
2 Referenced to drive edge.
3 Minimum SPORT divisor register value.
Table 30. Serial Ports—Enable and Three-State
Parameter
Min
Max
Unit
Switching Characteristics
t
DDTEN
1
Data Enable from External Transmit SCLK
2
ns
t
DDTTE
1
Data Disable from External Transmit SCLK
10
ns
t
DDTIN
1
Data Enable from Internal Transmit SCLK
–1
ns
1 Referenced to drive edge.
Table 31. Serial Ports—External Late Frame Sync
Parameter
Min
Max
Unit
Switching Characteristics
t
DDTLFSE
1
Data Delay from Late External Transmit FS or External Receive
FS with MCE = 1, MFD = 0
7.75
ns
t
DDTENFS
1
Data Enable for MCE = 1, MFD = 0
0.5
ns
1 The t
DDTLFSE and tDDTENFS parameters apply to left-justified sample pair as well as DSP serial mode, and MCE = 1, MFD = 0.
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PDF描述 |
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| ADSP-21369BBPZ-2A | 功能描述:IC DSP 32BIT 333MHZ 256-BGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:SHARC® 标准包装:40 系列:TMS320DM64x, DaVinci™ 类型:定点 接口:I²C，McASP，McBSP 时钟速率:400MHz 非易失内存:外部 芯片上RAM:160kB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:0°C ~ 90°C 安装类型:表面贴装 封装/外壳:548-BBGA，FCBGA 供应商设备封装:548-FCBGA（27x27） 包装:托盘 配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA |
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