参数资料
型号: ADSP-21479KBCZ-3A
厂商: Analog Devices Inc
文件页数: 61/76页
文件大小: 0K
描述: IC DSP SHARK 300MHZ 196CSPBGA
标准包装: 1
系列: SHARC®
类型: 浮点
接口: DAI,DPI,EBI/EMI,I²C,SPI,SPORT,UART/USART
时钟速率: 300MHz
非易失内存: ROM(4Mb)
芯片上RAM: 5Mb
电压 - 输入/输出: 3.30V
电压 - 核心: 1.30V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 196-LFBGA,CSPBGA
供应商设备封装: 196-CSPBGA(12x12)
包装: 托盘
Rev. C
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July 2013
Universal Asynchronous Receiver-Transmitter
(UART) Ports—Receive and Transmit Timing
For information on the UART port receive and transmit opera-
tions, see the ADSP-214xx SHARC Hardware Reference Manual.
2-Wire Interface (TWI)—Receive and Transmit Timing
For information on the TWI receive and transmit operations,
see the ADSP-214xx SHARC Hardware Reference Manual.
JTAG Test Access Port and Emulation
Table 55. JTAG Test Access Port and Emulation
88-Lead LFCSP Package
All Other Packages
Unit
Parameter
Min
Max
Min
Max
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
5
ns
tHTAP
TDI, TMS Hold After TCK High
6
ns
tSSYS
1
1 System Inputs = DATA15–0, CLK_CFG1–0, RESET, BOOT_CFG1–0, DAI_Px, DPI_Px, FLAG3–0, MLBCLK, MLBDAT, MLBSIG, SR_SCLK, SR_CLR, SR_SDI, and
SR_LAT.
System Inputs Setup Before TCK High
7
ns
tHSYS
1
System Inputs Hold After TCK High
18
ns
tTRSTW
TRST Pulse Width
4 × tCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
11.5
10.5
ns
tDSYS
2
2 System Outputs = DAI_Px, DPI_Px, ADDR23–0, AMI_RD, AMI_WR, FLAG3–0, SDRAS, SDCAS, SDWE, SDCKE, SDA10, SDDQM, SDCLK, MLBDAT, MLBSIG, MLBDO,
MLBSO, SR_SDO, SR_LDO, and EMU.
System Outputs Delay After TCK Low
tCK ÷ 2 + 7
ns
Figure 46. IEEE 1149.1 JTAG Test Access Port
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tTCK
tSTAP
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
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