参数资料
型号: ADSP-BF516KBCZ-3
厂商: Analog Devices Inc
文件页数: 41/68页
文件大小: 0K
描述: IC DSP 16/32B 300MHZ 168CSPBGA
标准包装: 1
系列: Blackfin®
类型: 定点
接口: 以太网,I²C,PPI,RSI,SPI,SPORT,UART/USART
时钟速率: 300MHz
非易失内存: 外部
芯片上RAM: 116kB
电压 - 输入/输出: 1.8V,2.5V,3.3V
电压 - 核心: 1.30V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 168-LFBGA,CSPBGA
供应商设备封装: 168-CSPBGA(12x12)
包装: 托盘
Rev. B
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January 2011
ADSP-BF512/BF512F, BF514/BF514F, BF516/BF516F, BF518/BF518F
Table 44. 10/100 Ethernet MAC Controller Timing: MII Transmit Signal
VDDEXT
1.8V Nominal
VDDEXT
2.5 V/3.3V Nominal
Parameter
1
Min
Max
Min
Max
Unit
Switching Characteristics
tETF
ETxCLK Frequency (fSCLK = SCLK Frequency)
None
25 + 1%
None
25 + 1%
MHz
tETXCLKW
ETxCLK Width (tETxCLK = ETxCLK Period)
tETxCLK × 40%
tETxCLK × 60%
tETxCLK × 35%
tETxCLK × 65%
ns
tETXCLKOV
ETxCLK Rising Edge to Tx Output Valid (Data Out Valid)
20
ns
tETXCLKOH
ETxCLK Rising Edge to Tx Output Invalid (Data Out Hold) 0
0
ns
1 MII outputs synchronous to ETxCLK are ETxD3–0.
Figure 32. 10/100 Ethernet MAC Controller Timing: MII Transmit Signal
Table 45. 10/100 Ethernet MAC Controller Timing: RMII Receive Signal
VDDEXT
1.8V Nominal
VDDEXT
2.5 V/3.3V Nominal
Parameter
1
MinMax
Unit
Timing Requirements
tEREFCLKF
REF_CLK Frequency (fSCLK = SCLK Frequency)
None
50 + 1%
None
50 + 1%
MHz
tEREFCLKW
EREF_CLK Width (tEREFCLK = EREFCLK Period)
tEREFCLK × 40% tEREFCLK × 60%
tEREFCLK × 35% tEREFCLK × 65%
ns
tEREFCLKIS
Rx Input Valid to RMII REF_CLK Rising Edge (Data In
Setup)
44
ns
tEREFCLKIH
RMII REF_CLK Rising Edge to Rx Input Invalid (Data In
Hold)
22
ns
1 RMII inputs synchronous to RMII REF_CLK are ERxD1–0, RMII CRS_DV, and ERxER.
Figure 33. 10/100 Ethernet MAC Controller Timing: RMII Receive Signal
tETXCLKOH
ETxD3–0
ETxEN
MIITxCLK
tETXCLK
tETXCLKOV
tETXCLKW
tREFCLKIS
tREFCLKIH
ERxD1–0
ERxDV
ERxER
RMII_REF_CLK
tREFCLKW
tREFCLK
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ADSP-BF514KBCZ-4 IC DSP 16/32B 400MHZ 168CSPBGA
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参数描述
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