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参数资料
| 型号： | ADSP-BF542BBCZ-4A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 42/100页 |
| 文件大小： | 0K |
| 描述： | IC DSP 16BIT 400MHZ 400CSBGA |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | CAN，SPI，SSP，TWI，UART，USB |
| 时钟速率： | 400MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 132kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.25V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-LFBGA，CSPBGA |
| 供应商设备封装： | 400-CSPBGA（17x17） |
| 包装： | 托盘 |
| 配用： | ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548 |
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Rev. C
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February 2010
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Asynchronous Memory Write Cycle Timing
on Page 47 describe asynchronous memory write cycle opera-
tions for synchronous and for asynchronous ARDY.
Table 30. Asynchronous Memory Write Cycle Timing with Synchronous ARDY
Parameter
Min
Max
Unit
Timing Requirements
tSARDY
ARDY Setup Before the Falling Edge of CLKOUT
5.0
ns
tHARDY
ARDY Hold After the Falling Edge of CLKOUT
0.0
ns
Switching Characteristics
tDDAT
DATA15 – 0 Disable After CLKOUT
6.0
ns
tENDAT
DATA15 – 0 Enable After CLKOUT
0.0
ns
tDO
Output Delay After CLKOUT
1
6.0
ns
tHO
Output Hold After CLKOUT1
0.3
ns
1 Output pins include AMS3–0, ABE1–0, ADDR19–1, and AWE.
Figure 15. Asynchronous Memory Write Cycle Timing with Synchronous ARDY
SETUP
2 CYCLES
PROGRAMMED
WRITE ACCESS
2 CYCLES
ACCESS
EXTEND
1 CYCLE
HOLD
1 CYCLE
tDO
tHO
CLKOUT
AMSx
ABE1–0
ADDR19–1
AWE
DATA 15–0
tDO
tSARDY
tDDAT
tENDAT
tHO
tHARDY
ARDY
tSARDY
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